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5962-8752501BDA

更新时间: 2024-01-28 20:18:32
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德州仪器 - TI 触发器锁存器逻辑集成电路
页数 文件大小 规格书
16页 529K
描述
ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDFP14, CERAMIC, DFP-14

5962-8752501BDA 技术参数

生命周期:Obsolete零件包装代码:DFP
包装说明:DFP, FL14,.3针数:14
Reach Compliance Code:unknownHTS代码:8542.39.00.01
风险等级:5.1系列:ACT
JESD-30 代码:R-GDFP-F14JESD-609代码:e0
负载电容(CL):50 pF逻辑集成电路类型:D FLIP-FLOP
最大频率@ Nom-Sup:85000000 Hz最大I(ol):0.024 A
位数:1功能数量:2
端子数量:14最高工作温度:125 °C
最低工作温度:-55 °C输出极性:COMPLEMENTARY
封装主体材料:CERAMIC, GLASS-SEALED封装代码:DFP
封装等效代码:FL14,.3封装形状:RECTANGULAR
封装形式:FLATPACK电源:5 V
传播延迟(tpd):14 ns认证状态:Not Qualified
筛选级别:MIL-PRF-38535座面最大高度:2.032 mm
子类别:FF/Latches最大供电电压 (Vsup):5.5 V
最小供电电压 (Vsup):4.5 V标称供电电压 (Vsup):5 V
表面贴装:YES技术:CMOS
温度等级:MILITARY端子面层:TIN LEAD
端子形式:FLAT端子节距:1.27 mm
端子位置:DUAL触发器类型:POSITIVE EDGE
宽度:6.2865 mm最小 fmax:95 MHz
Base Number Matches:1

5962-8752501BDA 数据手册

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SCAS520H − AUGUST 1995 − REVISED OCTOBER 2003  
FUNCTION TABLE  
(each flip-flop)  
INPUTS  
OUTPUTS  
CLR  
PRE  
L
CLK  
X
D
X
X
X
H
L
Q
H
L
Q
L
H
L
H
X
H
H
L
L
X
H
H
H
H
H
H
L
L
H
H
H
L
X
Q
Q
0
0
This configuration is nonstable; that is, it does not  
persist when either PRE or CLR returns to its  
inactive (high) level.  
logic diagram, each flip-flop (positive logic)  
PRE  
CLK  
C
C
C
TG  
C
Q
C
TG  
C
C
TG  
C
C
TG  
C
D
Q
CLR  
2
POST OFFICE BOX 655303 DALLAS, TEXAS 75265  

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