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5962-0324601V9A

更新时间： 2024-02-07 01:05:52
品牌 Logo 应用领域
爱特美尔 - ATMEL 微控制器和处理器外围集成电路微处理器时钟
页数 文件大小 规格书
42页 3365K
描述
Low-Voltage Rad-Hard 32-bit SPARC Embedded Processor

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5962-0324601V9A 技术参数

生命周期：Active包装说明：DIE,
Reach Compliance Code：compliantECCN代码：3A001.A.2.C
HTS代码：8542.31.00.01风险等级：5.71
地址总线宽度：32位大小：32
边界扫描：YES最大时钟频率：30.3 MHz
外部数据总线宽度：32格式：FLOATING POINT
集成缓存：NOJESD-30 代码：X-XUUC-N
低功率模式：YES最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：UNSPECIFIED
封装代码：DIE封装形状：UNSPECIFIED
封装形式：UNCASED CHIP认证状态：Qualified
筛选级别：MIL-PRF-38535 Class V速度：15 MHz
最大供电电压：3.45 V最小供电电压：3.15 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子形式：NO LEAD端子位置：UPPER
uPs/uCs/外围集成电路类型：MICROPROCESSOR, RISCBase Number Matches：1

5962-0324601V9A 数据手册

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TSC695FL  
Signal  
Type  
Active  
Description  
OE  
O
O
O
O
O
O
O
I
Low  
Low  
High  
Low  
Low  
Low  
Low  
Low  
Low  
Low  
Low  
High  
Low  
Low  
Low  
Low  
Low  
High  
Low  
High  
High  
High  
High  
High  
Memory output enable  
Data buffer enable  
Output buffer: 400 pF  
BUFFEN  
DDIR  
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
Data buffer direction  
Data buffer direction  
I/O chip select  
DDIR  
IOSEL[3:0]  
IOWR  
I/O and exchange memory write strobe  
Exchange memory chip select  
Bus ready  
EXMCS  
BUSRDY  
BUSERR  
DMAREQ  
DMAGNT  
DMAAS  
DRDY  
I
Bus error  
I
DMA request  
O
I
DMA grant  
DMA address strobe  
Data ready during DMA access  
IU error  
O
O
O
O
I
IUERR  
CPUHALT  
SYSERR  
SYSHALT  
SYSAV  
NOPAR  
INULL  
Processor (IU & FPU) halt and freeze  
System error  
System halt  
O
I
System availability  
No parity  
O
O
O
O
O
I
Integer unit nullify cycle  
Instruction fetch  
INST  
Used to check the execute  
stage of IU  
FLUSH  
DIA  
FPU instruction flush  
Delay instruction annulled  
Real Time Clock Counter output  
Receive data UART ’A’ and ’B’  
Transmit data UART ’A’ and ’B’  
GPI input/output  
instruction pipeline  
RTC  
-
RxA/RxB  
TxA/TxB  
GPI[7:0]  
GPIINT  
EXTINT[4:0]  
EXTINTACK  
IWDE  
Input trigger  
O
I/O  
O
I
-
Input trigger  
High  
GPI interrupt  
-
External interrupt  
Input trigger  
O
I
High  
High  
High  
External interrupt acknowledge  
Internal watch dog enable  
External watch dog input interrupt  
Watch dog clock  
-
-
EWDINT  
WDCLK  
CLK2  
I
Input trigger  
I
-
I
Double frequency clock  
System clock  
-
SYSCLK  
RESET  
SYSRESET  
TMODE[1:0]  
DEBUG  
TCK  
O
O
I
-
Low  
Low  
Output reset  
-
System input reset  
Factory test mode  
Input trigger  
I
Functional mode=00  
I
High  
Low  
Software debug mode  
Test (JTAG) clock  
-
I
-
TRST  
I
Test (JTAG) reset  
pull-up ≈ 37 kΩ  
TMS  
I
Test (JTAG) mode select  
Test (JTAG) data input  
Test (JTAG) data output  
Main internal power  
Output driver power  
pull-up ≈ 37 kΩ  
TDI  
I
pull-up ≈ 37 kΩ  
TDO  
O
-
-
-
VCCI/VSSI  
VCCO/VSSO  
Note:  
If not specified, the output buffer type is 150 pF, the input buffer type is TTL.  
3
4204C–AERO–05/05  
1234567...42

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