54F109FM

更新时间： 2024-01-19 10:29:16

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美国国家半导体 - NSC		触发器逻辑集成电路
页数	文件大小	规格书
10页	136K
描述
Dual JK Positive Edge-Triggered Flip-Flop

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54F109FM 技术参数

生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP,	针数：	16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.28	系列：	F/FAST
JESD-30 代码：	R-CDIP-T16	逻辑集成电路类型：	J-KBAR FLIP-FLOP
位数：	2	功能数量：	2
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出极性：	COMPLEMENTARY
封装主体材料：	CERAMIC, METAL-SEALED COFIRED	封装代码：	DIP
封装形状：	RECTANGULAR	封装形式：	IN-LINE
传播延迟（tpd）：	10.5 ns	认证状态：	Not Qualified
座面最大高度：	5.08 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	TTL
温度等级：	MILITARY	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
触发器类型：	POSITIVE EDGE	宽度：	7.62 mm
最小 fmax：	125 MHz

54F109FM 数据手册

Connection Diagrams

Pin Assignment

for DIP, SOIC and Flatpak

Pin Assignment

for LCC

DS009471-1

DS009471-2

Unit Loading/Fan Out

See Section 0 for U.L. definitions

DSXXX

54F/74F

Pin Names

Description

U.L.

HIGH/LOW

1.0/1.0

Input I_IH/I_IL

Output I_OH/I_OL

20 µA/−0.6 mA

20 µA/−1.8 mA

−1 mA/20 mA

J₁, J₂, K₁, K₂

CP₁, CP₂

Data Inputs

Clock Pulse Inputs (Active Rising Edge)

Direct Clear Inputs (Active LOW)

Direct Set Inputs (Active LOW)

Outputs

1.0/1.0

_D1, C_D2

1.0/3.0

_D1, S_D2

1.0/3.0

Q₁, Q₂, Q₁, Q₂

50/33.3

Truth Table

Inputs

Outputs

S_D

C_D

Toggle

Q₀

H (h) HIGH Voltage Level

L (l) LOW Voltage Level

N =

LOW-to-HIGH Transition

Immaterial

(Q ) Before LOW-to-HIGH Transition of Clock

Lower case letters indicate the state of the referenced output one setup time prior to the LOW-to-HIGH clock transition.

www.national.com

PrintDate=1997/08/28 PrintTime=11:45:23 10182 ds009471 Rev. No. 1 cmserv Proof

123 4 5 6 7...10

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