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54ACTQ32DM

更新时间： 2024-01-14 18:39:03

品牌	Logo	应用领域
德州仪器 - TI		栅极逻辑集成电路
页数	文件大小	规格书
11页	542K
描述
ACT SERIES, QUAD 2-INPUT OR GATE, CDIP14, CERAMIC, DIP-14

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54ACTQ32DM 技术参数

生命周期：	Obsolete	包装说明：	DFP-14
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.71	Is Samacsys：	N
其他特性：	LG-MAX	系列：	ACT
JESD-30 代码：	R-GDFP-F14	长度：	9.9 mm
逻辑集成电路类型：	OR GATE	功能数量：	4
输入次数：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-55 °C
封装主体材料：	CERAMIC, GLASS-SEALED	封装代码：	DFP
封装形状：	RECTANGULAR	封装形式：	FLATPACK
传播延迟（tpd）：	7.5 ns	座面最大高度：	2.02 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	MILITARY
端子形式：	FLAT	端子节距：	1.27 mm
端子位置：	DUAL	宽度：	6.35 mm
Base Number Matches：	1

54ACTQ32DM 数据手册

54ACTQ32–QMLV RH Electrical Characteristics (Continued)

Delta Parameters

The following conditions apply, unless otherwise specified.

Burn-in and operating life test, Delta parameters (+25˚C)

Sub-

groups

Symbol

I_CCH

I_CCL

Parameter

Conditions

Notes

Min Max

Units

Quiescent supply current

(Note 11),

(Note 12)

(Note 11),

(Note 12)

100

Quiescent supply current

100

Note 1: Absolute maximum ratings are those values beyond which damage to the device may occur. The databook specifications should be met, without exception,

to ensure that the system design is reliable over its power supply, temperature, and output/input loading variables. National does not recommend operation of

™

FACT circuits outside databook specifications.

Note 2: Screen tested 100% on each device +25˚C & +125˚C temperature, Subgroup 1, 2, 7 & 8.

Note 3: Sample tested (TM5005, Table 1) on each manufacturing lot +25˚C, +125˚C, & −55˚C, Subgroups A1, 2, 3, 7, & 8

Note 4: Screen tested 100% on each device +25˚C, only. Subgroup A9.

Note 5: Sample tested (TM5005, Table 1) on each manufacturing lot +25˚C, +125˚C, & −55˚C temperature, Subgroups A9, 10 & 11

Note 6: Transmission line driving test, guardbanded limits set for +25˚C, 2mS duration maximum

Note 7: Guaranteed but not tested. Design characterization data

Note 8: +25˚C, & +125˚C minimum limits guaranteed for 5.5V by guardbanding 4.5V minimum limits.

Note 9: Maximum number of outputs defined as (n) switching. Data inputs are driven 0V to 3V. One output

Note 10: Maximum number of data inputs (n) switching. (n-1) inputs switching 0V to 3V. Input-Under-Test switching 3V to threshold (V , 0V to threshold V , ƒ

ILD

IHD

= 1MHz

Note 11: These parameters shall be recorded before and after the required burn-in and life tests to determine the delta limits.

Note 12: This limit may not be production tested.

www.national.com

1...4 5 678 9 10 11

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型号	品牌	描述	获取价格	数据表
54ACTQ32DM-MLS	TI	ACT SERIES, QUAD 2-INPUT OR GATE, CDIP14, CERAMIC, DIP-14	获取价格
54ACTQ32DMQB	NSC	IC ACT SERIES, QUAD 2-INPUT OR GATE, CDIP14, Gate	获取价格
54ACTQ32E-QMLV	ETC	Quad 2-input OR Gate	获取价格
54ACTQ32ERQMLV	ETC	Quad 2-input OR Gate	获取价格
54ACTQ32F	NSC	Quiet Series Quad 2-Input OR Gate	获取价格
54ACTQ32FM	TI	ACT SERIES, QUAD 2-INPUT OR GATE, CDFP14, CERAMIC, DFP-14	获取价格

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