54ACT74FMQB

更新时间： 2024-01-27 05:36:07

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美国国家半导体 - NSC		触发器
页数	文件大小	规格书
8页	180K
描述
IC ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDFP14, CERAMIC, DFP-14, FF/Latch

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54ACT74FMQB 技术参数

生命周期：	Active	Reach Compliance Code：	compliant
风险等级：	5.73	Is Samacsys：	N
系列：	ACT	JESD-30 代码：	S-CQCC-N20
长度：	8.89 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	D FLIP-FLOP	最大频率@ Nom-Sup：	85 Hz
最大I（ol）：	24 A	位数：	1
功能数量：	2	端子数量：	20
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出极性：	COMPLEMENTARY	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	QCCN	封装等效代码：	LCC20,.35SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
Prop。Delay @ Nom-Sup：	14 ns	传播延迟（tpd）：	14 ns
筛选级别：	MIL-STD-883B	座面最大高度：	1.905 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子形式：	THROUGH-HOLE	端子节距：	1.27 mm
端子位置：	DUAL	触发器类型：	POSITIVE EDGE
宽度：	8.89 mm	最小 fmax：	85 MHz
Base Number Matches：	1

Connection Diagrams

Pin Assignment for DIP

and Flatpak

Pin Assignment for LCC

10026604

10026605

Truth Table

(Each Half)

Inputs

Outputs

S_D

C_D

Q₀

H = HIGH Voltage Level

L = LOW Voltage Level

X = Immaterial

= LOW-to-HIGH Clock Transition

Q (Q ) = Previous Q(Q) before LOW-to-HIGH Transition of Clock

Logic Diagram

10026606

Please note that this diagram is provided only for the understanding of logic operations and should not be used to estimate propagation delays.

www.national.com

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型号	品牌	描述	获取价格	数据表
54ACT74L	NSC	Dual D-Type Positive Edge-Triggered Flip-Flop	获取价格
54ACT74LM	FAIRCHILD	D Flip-Flop, ACT Series, 2-Func, Positive Edge Triggered, 1-Bit, Complementary Output, CMO	获取价格
54ACT74LM	TI	ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CQCC20, CERAMI	获取价格
54ACT74LMQB	NSC	IC ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CQCC20, CER	获取价格
54ACT74MDA	TI	IC ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, UUC14, DIE,	获取价格
54ACT74MDS	TI	ACT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, UUC14, DIE	获取价格