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Datasheet > 信号电路 > 复用器或开关> 4066-S14-T
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4066-S14-T

更新时间： 2024-01-16 05:42:53
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友顺 - UTC 复用器开关复用器或开关信号电路光电二极管
页数 文件大小 规格书
7页 151K
描述
QUAD BILATERAL SWITCH

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4066-S14-T 技术参数

生命周期：Active零件包装代码：SOIC
包装说明：LSOP,针数：14
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.58模拟集成电路 - 其他类型：SPST
JESD-30 代码：R-PDSO-G14JESD-609代码：e0
长度：8.55 mm信道数量：4
功能数量：4端子数量：14
通态电阻匹配规范：10 Ω最大通态电阻 (Ron)：1050 Ω
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, LOW PROFILE
认证状态：Not Qualified座面最大高度：1.7 mm
最大供电电压 (Vsup)：15 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：5 V表面贴装：YES
最长断开时间：125 ns最长接通时间：125 ns
技术：CMOS温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：3.95 mmBase Number Matches：1

4066-S14-T 数据手册

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4066  
CMOS IC  
ꢀ
SPECIAL CONSIDERATIONS  
In applications where separate power sources are used to drive VDD and the signal input, the VDD current capability  
should exceed VDD/RL (RL=effective external load of the UTC 4066 bilateral switches).This provision avoids any  
permanent current flow or clamp action of the VDD supply when power is applied or removed from UTC 4066.  
In certain applications, the external load-resistor current may include both VDD and Signal-line components. To  
avoid drawing VDD current when switch current flows into terminals 1,4,8 or 11,the voltage drop across the  
bidirectional swith must not exceed 0.6V at Ta ≤ 25℃, or 0.4V at Ta >25℃ (calculated from RON values shown).  
NO VDD current will flow through RL if the switch current flows into terminals2, 3, 9 or 10.  
ꢀ
AC TEST CIRCUITS AND SWITCHING TIME WAVEFORMS  
VDD  
tf  
tf  
VC=VDD  
VDD  
90%  
50%  
CONTROL  
VDD  
V
IS  
1
4
OF  
10%  
VIS  
VOS  
0V  
OUT/IN  
IN/OUT  
tPLN  
tPNL  
CL  
RL  
200  
VDD  
SWITCHES  
p
50 F  
KΩ  
50%  
VOS  
Vss  
0V  
FIGURE 1. tPHL, tPLH Propagation Delay Time Signal Input to Signal Output  
tPZH  
tPHZ  
50%  
VDD  
VDD  
VC  
VDD  
VDD  
CONTROL  
IN/OUT  
50%  
tPZH  
VDD  
1 OF4  
0V  
0V  
V =VDD  
VOS  
IS  
OUT/IN  
t
PHZ  
VOH  
VOH  
CL  
50pF  
RL  
1KΩ  
SWITCHES  
90%  
Vss  
10%  
0V  
0V  
FIGURE 2. tPZH  
t
Propagation Delay Time Control to Signal Output  
,
PHZ  
tPZL  
tPLZ  
VDD  
VDD  
VC  
VDD  
VDD  
50%  
50%  
RL  
VDD  
CONTROL  
1KΩ  
VOS  
0V  
0V  
OF4  
1
tPLZ  
tPZL  
V =0V  
IS  
OUT/IN  
IN/OUT  
VDD  
VDD  
90%  
CL  
50  
SWITCHES  
Vss  
10%  
F
p
VOL  
VOL  
FIGURE 3. tPZL  
t
PLZ  
,
Propagation Delay Time Control to Signal Output  
5V  
VC  
2.5V  
CONTROL  
1OF 4  
V
DD  
V
IS = 0V  
V
VOS  
IN/OUT  
OUT/IN  
IS  
-2.5V  
SWITCHES  
Vss  
RL  
1/f  
-5V  
Vc=VDD for distortion and frequency response tests  
Vc=Vss for feedthrough test  
FIGURE 4.  
Sine Wave Distortion  
, Frequency Response and Feedthrough  
UNISONIC TECHNOLOGIES CO., LTD  
5 of 7  
QW-R502-009,C  
www.unisonic.com.tw  
1234567

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