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1522MLF

更新时间： 2024-01-24 11:17:01
品牌 Logo 应用领域
艾迪悌 - IDT 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
14页 452K
描述
SOIC-24, Tube

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1522MLF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：LEAD FREE, SOIC-24针数：24
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.68
其他特性：DIFFERENTIAL O/PS; PHASE COMPARATOR GAIN O/PSJESD-30 代码：R-PDSO-G24
JESD-609代码：e3长度：15.24 mm
湿度敏感等级：1端子数量：24
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：230 MHz封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
主时钟/晶体标称频率：20 MHz认证状态：Not Qualified
最大供电电压：5.25 V最小供电电压：4.75 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn) - annealed端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.493 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, VIDEOBase Number Matches：1

1522MLF 数据手册

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ICS1522  
User-Programmable Video Clock Generator/ Line-Locked Clock Regenerator  
TSD  
REG#  
4
BIT(S)  
3-5  
BIT REF.  
PFD (0;2)  
DESCRIPTION  
Phase Frequency Detector Gain  
FINE PHASE  
ADJ.  
PFD(2)  
PFD(1)  
PFD(0)  
PFD GAIN  
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
.2344uA/2Πrad  
.9375uA/2Πrad  
3.750uA/2Πrad  
15.00uA/2Πrad  
1.875uA/2Πrad  
7.500uA/2Πrad  
30.00uA/2Πrad  
120.0uA/2Πrad  
3ns/V  
3ns/V  
3ns/V  
3ns/V  
6ns/V  
6ns/V  
1.5ns/V  
.375ns/V  
4
4
6
7
PDEN  
Phase Frequency Detector Enable  
(Default=1) 0=PFD Disable; 1=PFD Enable  
INT_FLT  
Loop Filter Select (Default=1)  
0=External Loop Filter (IPUMP & VVCO active)  
1=Internal Loop Filter  
4
4
8
9
INT_VCO  
CLK_SEL  
VCO Select (Default=1)  
0=External VCO (EXTVCO active)  
1=Internal VCO  
Feedback Divider Clock Input Select (Default=0)  
0=VCO; 1=OUT1  
4
5
10  
0
RESERVED  
FBK_SEL  
Must be set to one.  
Feedback Select (Default=1)  
0=External Feedback (EXTFBK active)  
1=Internal Feedback An active external feedback signal at EXTFBK  
is necessary to synchronously switch to internal.  
5
5
5
1
2
3
FBK_POL  
ADD  
External Feedback Polarity (Default=0)  
0=Positive Edge; 1=Negative Edge  
Addition of 1 VCO Cycle (Default=0)  
Toggle (0 to 1 to 0) to add 1 VCO cycle.  
SWLW  
Removal of 1 VCO Cycle (Default=0)  
Toggle (0 to 1 to 0) to remove 1 VCO cycle.  
IDT™ / ICS™ User-Programmable Video Clock Generator/ Line-Locked Clock Regenerator  
ICS1522  
6
1...3456789...14

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型号 品牌 描述 获取价格 数据表
1522MLFT IDT Video Clock Generator, 230MHz, CMOS, PDSO24, LEAD FREE, SOIC-24

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