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MAX3877EHJ+

更新时间： 2024-02-18 21:24:18
品牌 Logo 应用领域
美信 - MAXIM 时钟
页数 文件大小 规格书
16页 551K
描述
Clock Recovery Circuit, 1-Func, Bipolar, PQFP32, 5 X 5 MM, 1 MM HEIGHT, EXPOSED PAD, TQFP-32

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MAX3877EHJ+ 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Obsolete零件包装代码：QFP
包装说明：TFQFP,针数：32
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.81Is Samacsys：N
JESD-30 代码：S-PQFP-G32JESD-609代码：e3
长度：5 mm湿度敏感等级：1
功能数量：1端子数量：32
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TFQFP
封装形状：SQUARE封装形式：FLATPACK, THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1.2 mm标称供电电压：3.3 V
表面贴装：YES技术：BIPOLAR
电信集成电路类型：ATM/SONET/SDH CLOCK RECOVERY CIRCUIT温度等级：INDUSTRIAL
端子面层：TIN端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：5 mm
Base Number Matches：1

MAX3877EHJ+ 数据手册

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2.5Gbps, +3.3V Clock and Data Retiming ICs  
with Vertical Threshold Adjust  
AC ELECTRICAL CHARACTERISTICS (continuedV  
(V  
= +3.0V to +3.6V, T = -40°C to +85°C, unless otherwise noted. Typical values are at V  
= +3.3V and T = +25°C.)  
CC A  
CC  
A
(Note 6)  
PARAMETER  
SYMBOL  
CONDITIONS  
MIN  
TYP  
MAX  
UNITS  
f = 70kHz  
3.18  
f = 100kHz (see “Jitter Tolerance” graph in  
Typical Operating Characteristics)  
2.75  
Jitter Tolerance  
UIp-p  
f = 1MHz  
0.41  
0.36  
0.67  
0.45  
f = 10MHz  
0.003  
0.026  
0.006  
0.056  
120  
UI  
RMS  
Jitter Generation  
J
Jitter bandwidth = 12kHz to 20MHz  
GEN  
UIp-p  
ps  
Clock Output Edge Speed  
Data Output Edge Speed  
(20% to 80%)  
(20% to 80%)  
120  
ps  
Tolerated Consecutive Identical  
Digits  
BER ≤ 10-10  
2000  
bits  
dB  
100kHz to 2.5GHz  
2.5GHz to 4.0GHz  
17  
14.5  
14  
Input Return Loss (SDI , SLBI )  
PLL Acquisition Time  
LOS Assert Time  
ms  
µs  
µs  
1.65  
4.0  
LOS Deassert Time  
Low-Frequency Cutoff for  
DC-Cancellation Loop  
C
C
= 0.1µF  
10  
kHz  
PWD  
HOLDOmER SPECIFICATION  
VCO Frequency Drift Rate in the  
Absence of Data  
df/dt  
= 1µF  
6.2  
kHz/µs  
FIL  
PHASE ADJUST SPECIFICATION  
Minimum Phase Adjust Range  
(Note 7)  
(Note 8)  
-60  
-8  
+60  
+8  
ps  
ps  
Phase Adjust Stability  
Note ±: At T = -40°C, DC characteristics are guaranteed by design and characterization.  
A
Note 2: Excluding PECL output termination, CML outputs open.  
Note 3: Jitter specifications are guaranteed for this data input voltage range, measured by connecting THADJ to V . Guaranteed  
CC  
by design and characterization.  
Note 4: Jitter specifications are guaranteed when input threshold is set to ≤ 30% of the differential input swing. Measured with edge  
speed ≤ 150ps (Figure 3). Guaranteed by design and characterization.  
Note 5: Threshold setting stability is guaranteed by design and characterization.  
Note 6: AC characteristics are guaranteed by design and characterization.  
Note 7: Phase adjust is disabled when PHADJ is connected to V  
.
CC  
Note 1: Phase adjust stability is guaranteed over temperature and power-supply variation.  
4
_______________________________________________________________________________________  
1234567...16

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