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LTC1090AC

更新时间： 2024-02-07 17:04:05
品牌 Logo 应用领域
凌特 - Linear /
页数 文件大小 规格书
28页 343K
描述
Single Chip 10-Bit Data Acquisition System

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LTC1090AC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP20,.3
针数：20Reach Compliance Code：unknown
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.75最大模拟输入电压：5.05 V
最小模拟输入电压：-5.05 V转换器类型：ADC, SUCCESSIVE APPROXIMATION
JESD-30 代码：R-GDIP-T20JESD-609代码：e0
最大线性误差 (EL)：0.0488%标称负供电电压：-5 V
模拟输入通道数量：8位数：10
功能数量：1端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出位码：BINARY输出格式：SERIAL
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP20,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5,GND/-5 V认证状态：Not Qualified
采样速率：0.045 MHz采样并保持/跟踪并保持：SAMPLE
座面最大高度：5.08 mm子类别：Analog to Digital Converters
标称供电电压：5 V表面贴装：NO
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.62 mm
Base Number Matches：1

LTC1090AC 数据手册

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LTC1090  
U
U W  
CO VERTER A D ULTIPLEXER CHARACTERISTICS  
The ■ denotes specifications which  
apply over the full operating temperature range, otherwise specifications are TA = 25°C. (Note 3)  
LTC1090A  
LTC1090  
TYP  
PARAMETER  
Offset Error  
CONDITIONS  
(Note 4)  
MIN  
TYP  
MAX  
±0.5  
±0.5  
±1.0  
±1.0  
MIN  
MAX  
±0.5  
±0.5  
±2.0  
UNITS  
LSB  
■
■
■
■
Linearity Error  
Gain Error  
(Notes 4 and 5)  
(Note 4)  
LSB  
LSB  
Total Unadjusted Error  
V
= 5.000V  
LSB  
REF  
(Notes 4 and 6)  
Reference Input Resistance  
Analog and REF Input Range  
10  
10  
kΩ  
V
–
(Note 7)  
(V ) – 0.05V to V 0.05V  
CC  
On Channel Leakage Current  
(Note 8)  
On Channel = 5V  
Off Channel = 0V  
■
■
■
■
1
–1  
–1  
1
1
–1  
–1  
1
µA  
On Channel = 0V  
Off Channel = 5V  
µA  
µA  
µA  
Off Channel Leakage Current  
(Note 8)  
On Channel = 5V  
Off Channel = 0V  
On Channel = 0V  
Off Channel = 5V  
AC ELECTRICAL CHARACTERISTICS  
The ■ denotes specifications which apply over the full operating  
temperature range, otherwise specification are TA = 25°C. (Note 3)  
LTC1090/LTC1090A  
SYMBOL  
PARAMETER  
CONDITIONS  
MIN  
TYP  
MAX  
UNITS  
↓
t
t
t
t
t
t
t
t
t
Delay Time From CS to D  
Analog Input Sample Time  
Conversion Time  
Data Valid  
(Note 9)  
2
ACLK Cycles  
ACC  
SMPL  
CONV  
dDO  
dis  
OUT  
See Operating Sequence  
See Operating Sequence  
See Test Circuits  
See Test Circuits  
See Test Circuits  
5
SCLK Cycles  
44  
ACLK Cycles  
↓
Delay Time, SCLK to D  
Data Valid  
■
■
■
250  
300  
400  
50  
450  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
OUT  
↑
Delay Time, CS to D  
Hi-Z  
140  
150  
OUT  
↓
Delay Time, 2nd CLK to D  
Enabled  
ns  
en  
OUT  
↓
Time Output Data Remains Valid After SCLK  
hDO  
f
D
OUT  
D
OUT  
Fall Time  
See Test Circuits  
See Test Circuits  
■
■
90  
60  
300  
300  
ns  
ns  
Rise Time  
r
C
Input Capacitance  
Analog Inputs  
On Channel  
Off Channel  
65  
5
5
pF  
pF  
pF  
IN  
Digital Inputs  
1090fc  
3
1234567...28

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