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LTC1063CSW#PBF

更新时间： 2024-01-17 06:18:40
品牌 Logo 应用领域
凌特 - Linear 时钟
页数 文件大小 规格书
12页 319K
描述
LTC1063 - DC Accurate, Clock-Tunable 5th Order Butterworth Lowpass Filter; Package: SO; Pins: 16; Temperature Range: 0°C to 70°C

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LTC1063CSW#PBF 技术参数

是否Rohs认证：符合生命周期：Transferred
零件包装代码：SOIC包装说明：SOP, SOP16,.4
针数：16Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.33Is Samacsys：N
有源滤波器类型：SWITCHED CAPACITOR FILTER中心频率或截止频率最大范围：50 kHz
JESD-30 代码：R-PDSO-G16JESD-609代码：e3
长度：10.29 mm湿度敏感等级：1
负电源电压最大值（Vsup）：-8 V负电源电压最小值（Vsup）：-2.375 V
标称负供电电压 (Vsup)：-5 V功能数量：1
端子数量：16最高工作温度：85 °C
最低工作温度：-40 °C阶次：5TH
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
极和零点：5 AND 0电源：+-5 V
认证状态：Not Qualified响应：LOWPASS
座面最大高度：2.642 mm子类别：Active Filters
最大供电电流 (Isup)：14.5 mA最大供电电压 (Vsup)：8 V
最小供电电压 (Vsup)：2.375 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
传递特性：BUTTERWORTH宽度：7.5 mm
Base Number Matches：1

LTC1063CSW#PBF 数据手册

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LTC1063  
U
U
U
PI FU CTIO S  
filter’sDCoutputoffset(Figure1). RIN should, however, be Clock Output Pin (Pin 4, N Package)  
limited to a maximum value (Table 1), otherwise the filter’s  
passband flatness will be affected. Refer to the Applica-  
tions Information section for more details.  
Any external clock applied to the clock input pin appears  
at the clock output pin. The duty cycle of the clock output  
equals the duty cycle of the external clock applied to the  
clock input pin. The clock output pin swings to the power  
supply rails. When the LTC1063 is used in a self-clocking  
mode, the clock of the internal oscillator appears at the  
clock output pin with a 30% duty cycle. The clock output  
pin can be used to drive other LTC1063s or other ICs. The  
maximum capacitance, CL(MAX), the clock output pin can  
drive is illustrated in Figure 3.  
R
IN  
1
2
3
4
8
7
6
5
V
IN  
V
OUT  
LTC1063  
–
+
V
V
f
CLK  
1063 F01  
Figure 1.  
Table 1. RIN(MAX) vs Clock and Power Supply  
200  
R
IN(MAX)  
T = 25°C  
A
180  
160  
140  
120  
100  
80  
V
= ±2.5V  
S
V = ±7.5V  
S
V = ±5V  
S
V = ±2.5V  
S
f
f
= 4MHz  
= 3MHz  
2.2k  
3.4k  
–
–
–
CLK  
CLK  
2.9k  
V
= ±5V  
S
f
f
f
f
= 2MHz  
= 1MHz  
= 500kHz  
= 100kHz  
5.5k  
11k  
24k  
5k  
11k  
23k  
120k  
2.7k  
9.2k  
21k  
CLK  
CLK  
CLK  
CLK  
V
= ±7.5V  
S
60  
40  
120k  
110k  
20  
0
Output Pin (Pin 7, N Package)  
1
3
6
9 10  
8
2
4
5
7
CLOCK FREQUENCY (MHz)  
1063 F03  
Pin 7 is the filter output. This pin can typically source over  
20mA and sink 2mA. Pin 7 should not drive long coax  
cables, otherwise the filter’s total harmonic distortion will  
degrade.  
Figure 3. Maximum Load Capacitance at the Clock Output Pin  
Clock Input Pin (Pin 5, N Package)  
TEST CIRCUIT  
An external clock when applied to pin 5 tunes the filter  
cutoff frequency. The clock-to-cutoff frequency ratio is  
100:1. The high (VHIGH) and low (VLOW) clock logic  
threshold levels are illustrated in Table 2. Square wave  
clockswithdutycyclesbetween30%and50%arestrongly  
recommended. Sinewave clocks are not recommended.  
+
V
OUT  
LT1022  
50k  
–
1
8
7
6
5
V
IN  
50k  
2
LTC1063  
3
+
V
–
Table 2. Clock Pin Threshold Levels  
V
20pF  
0.1µF  
4
POWER SUPPLY  
V = ±2.5V  
V = ±5V  
S
V
1.5V  
3V  
V
LOW  
0.5V  
1V  
HIGH  
0.1µF  
CLOCK IN  
1063 TC01  
S
V = ±7.5V  
4.5V  
4.8V  
4V  
1.5V  
1.6V  
3V  
S
V = ±8V  
S
Figure 2. Test Circuit for THD  
V = 5V, 0V  
S
V = 12, 0V  
V =15V, 0V  
S
9.6V  
12V  
7.2V  
9V  
S
7
1...45678910...12

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