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ICX432DQF PDF预览

ICX432DQF

更新时间： 2024-02-18 18:27:20
品牌 Logo 应用领域
索尼 - SONY 传感器图像传感器光电二极管摄像机
页数 文件大小 规格书
30页 301K
描述
Diagonal 6.67mm (Type 1/2.7) Frame Readout CCD Image Sensor with a Square Pixel for Color Cameras

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ICX432DQF 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP,针数：18
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.58Is Samacsys：N
模拟集成电路 - 其他类型：ANALOG CIRCUITJESD-30 代码：S-PDSO-G18
JESD-609代码：e4长度：10 mm
功能数量：1端子数量：18
最高工作温度：75 °C最低工作温度：-10 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：SQUARE封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：2.65 mm最大供电电压 (Vsup)：15.45 V
最小供电电压 (Vsup)：14.55 V标称供电电压 (Vsup)：15 V
表面贴装：YES温度等级：COMMERCIAL EXTENDED
端子面层：Gold (Au)端子形式：GULL WING
端子节距：1.1 mm端子位置：DUAL
处于峰值回流温度下的最长时间：10宽度：10 mm
Base Number Matches：1

ICX432DQF 数据手册

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ICX432DQF  
Bias Conditions  
Item  
Symbol  
VDD  
Min.  
Typ.  
Max.  
Unit Remarks  
V
Supply voltage  
Protective transistor bias  
Substrate clock  
Reset gate clock  
1
14.55  
15.0  
15.45  
VL  
1
2
2
φSUB  
φRG  
VL setting is the VVL voltage of the vertical clock waveform, or the same voltage as the VL power supply for  
the V driver should be used.  
2
Do not apply a DC bias to the substrate clock and reset gate clock pins, because a DC bias is generated  
within the CCD.  
DC Characteristics  
Item  
Symbol  
Min.  
5.0  
Typ.  
7.0  
Max.  
9.0  
Unit Remarks  
mA  
Supply current  
IDD  
Clock Voltage Conditions  
Waveform  
Diagram  
Item  
Symbol  
Min.  
Typ.  
Max. Unit  
Remarks  
Readout clock voltage VVT  
14.55 15.0 15.45  
V
V
V
1
2
2
VVH1, VVH2  
VVH3, VVH4  
VVH = (VVH1 + VVH2 + VVH3  
+ VVH4)/2  
–0.05  
–0.2  
0
0
0.05  
0.05  
VVH5, VVH6  
VVL1, VVL2,  
VVL3, VVL4,  
VVL5, VVL6  
–8.0  
–7.5  
–7.0  
V
2
VVL = (VVL5 + VVL6)/2  
VφV  
6.8  
7.5  
8.05  
0.1  
0.1  
0.8  
0.9  
0.9  
0.8  
3.6  
0.05  
V
V
V
V
V
V
V
V
V
V
V
V
V
V
2
2
2
2
2
2
2
3
3
3
4
4
4
5
Vφ = VVHn – VVLn (n = 1 to 6)  
V
Vertical transfer clock  
voltage  
VVH5 – VVH  
VVH6 – VVH  
VVHH  
–0.25  
–0.25  
High-level coupling  
High-level coupling  
Low-level coupling  
Low-level coupling  
VVHL  
VVLH  
VVLL  
VφH  
3.0  
–0.05  
0.5  
3.3  
0
Horizontal transfer  
clock voltage  
VHL  
VCR  
1.65  
3.3  
Cross-point voltage  
VφRG  
3.0  
3.6  
0.4  
Reset gate clock  
voltage  
VRGLH – VRGLL  
VRGL – VRGLm  
Low-level coupling  
Low-level coupling  
0.5  
Substrate clock voltage VφSUB  
21.5  
22.5  
23.5  
– 4 –  
1234567...30

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