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EP1K50FC484-2

更新时间： 2023-01-02 21:15:24

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英特尔 - INTEL		时钟 LTE 栅可编程逻辑
页数	文件大小	规格书
91页	1288K
描述
Loadable PLD, 0.4ns, CMOS, PBGA484, FINE LINE, BGA-484

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EP1K50FC484-2 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
包装说明：	BGA, BGA484,22X22,40	Reach Compliance Code：	compliant
风险等级：	5.91	JESD-30 代码：	S-PBGA-B484
JESD-609代码：	e0	湿度敏感等级：	3
输入次数：	249	逻辑单元数量：	2880
输出次数：	249	端子数量：	484
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	BGA
封装等效代码：	BGA484,22X22,40	封装形状：	SQUARE
封装形式：	GRID ARRAY	电源：	2.5,2.5/3.3 V
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	认证状态：	Not Qualified
子类别：	Field Programmable Gate Arrays	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	BALL
端子节距：	1 mm	端子位置：	BOTTOM
Base Number Matches：	1

EP1K50FC484-2 数据手册

ACEX 1K

Programmable Logic Device Family

May 2003, ver. 3.4

Data Sheet

■

Programmable logic devices (PLDs), providing low cost

system-on-a-programmable-chip (SOPC) integration in a single

device

Features...

–

Enhanced embedded array for implementing megafunctions

such as efficient memory and specialized logic functions

Dual-port capability with up to 16-bit width per embedded array

block (EAB)

Logic array for general logic functions

■

High density

–

10,000 to 100,000 typical gates (see Table 1)

Up to 49,152 RAM bits (4,096 bits per EAB, all of which can be

used without reducing logic capacity)

Cost-efficient programmable architecture for high-volume

applications

–

Cost-optimized process

Low cost solution for high-performance communications

applications

■

System-level features

–

MultiVolt^TMI/ O pins can drive or be driven by 2.5-V, 3.3-V, or

5.0-V devices

–

Low power consumption

Bidirectional I/ O performance (setup time [t_SU] and clock-to-

output delay [t_CO]) up to 250 MHz

–

Fully compliant with the peripheral component interconnect

Special Interest Group (PCI SIG) PCI Local Bus Specification,

Revision 2.2 for 3.3-V operation at 33 MHz or 66 MHz

■

Extended temperature range

Table 1. ACEX^TM1K Device Features

Feature

EP1K10

EP1K30

EP1K50

EP1K100

Typical gates

10,000

56,000

576

30,000

119,000

1,728

50,000

199,000

2,880

100,000

257,000

4,992

Maximum system gates

Logic elements (LEs)

EABs

Total RAM bits

12,288

136

24,576

171

40,960

249

49,152

333

Maximum user I/O pins

Altera Corporation

DS-ACEX-3.4

12 3 4 5 6 7...91

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EP1K50FC484-2P	ETC	获取价格	Field Programmable Gate Array (FPGA)
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EP1K50FC484-3F	ETC	获取价格	Field Programmable Gate Array (FPGA)
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EP1K50FI256-1DX	ETC	获取价格	Field Programmable Gate Array (FPGA)
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