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CAT24C081JI-28TE13

更新时间： 2024-02-27 18:34:41
品牌 Logo 应用领域
CATALYST 微控制器和处理器外围集成电路uCs集成电路uPs集成电路光电二极管监控可编程只读存储器
页数 文件大小 规格书
12页 89K
描述
Supervisory Circuits with I2C Serial CMOS E2PROM, Precision Reset Controller and Watchdog Timer

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CAT24C081JI-28TE13 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP,
针数：8Reach Compliance Code：unknown
HTS代码：8542.31.00.01风险等级：5.92
JESD-30 代码：R-PDSO-G8JESD-609代码：e0
长度：4.9 mm端子数量：8
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
认证状态：Not Qualified座面最大高度：1.75 mm
最大供电电压：6 V最小供电电压：2.7 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：3.9 mmuPs/uCs/外围集成电路类型：MICROPROCESSOR CIRCUIT
Base Number Matches：1

CAT24C081JI-28TE13 数据手册

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CAT24CXX1/XX2  
Advanced  
Reset Threshold Voltage  
Hardware Data Protection  
From the factory the 24CXXX is offered in five different  
variations of reset threshold voltages. They are 4.50-  
4.75V, 4.25-4.50V, 3.00-3.15V, 2.85-3.00V and 2.55-  
2.70V. To provide added flexibility to design engineers  
using this product, the 24CXXX is designed with an  
additional feature of programming the reset threshold  
voltage. This allows the user to change the existing  
reset threshold voltage to one of the other four reset  
threshold voltages. Once the reset threshold voltage is  
selected it will not change even after cycling the power,  
unless the user uses the programmer to change the  
reset threshold voltage. However, the programming  
functionisavailableonlythroughthirdpartyprogrammer  
manufacturers. PleasecallCatalystforalistofprogram-  
mer manufacturers who support this function.  
The 24CXXX is designed with the following hardware  
data protection features to provide a high degree of data  
integrity.  
(1) The24CXXXfeaturesaWPpin.WhenWPpin istied  
high the entire memory array becomes write protected  
(read only).  
(2) The VCC sense provides write protection when VCC  
fallsbelowtheresetthresholdvalue(VTH). TheVCC lock  
out inhibits writes to the serial EEPROM whenever VCC  
falls below (power down) VTH or until VCC reaches the  
reset threshold (power up) VTH  
.
Figure 2. Bus Timing  
t
t
t
F
HIGH  
R
t
t
LOW  
LOW  
SCL  
t
t
HD:DAT  
SU:STA  
t
t
t
t
HD:STA  
SU:DAT  
SU:STO  
SDA IN  
BUF  
t
t
DH  
AA  
SDA OUT  
Figure 3. Write Cycle Timing  
SCL  
SDA  
8TH BIT  
BYTE n  
ACK  
t
WR  
STOP  
CONDITION  
START  
CONDITION  
ADDRESS  
Figure 4. Start/Stop Timing  
SDA  
SCL  
START BIT  
STOP BIT  
Doc. No. 25079-00 1/98 M-1  
6
1...3456789...12

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