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ATF1516AS-15QI160

更新时间： 2024-01-28 12:40:37
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描述
ASIC

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ATF1516AS-15QI160 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFP包装说明：PLASTIC, QFP-160
针数：160Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.92
最大时钟频率：100 MHzJESD-30 代码：S-PQFP-G160
长度：28 mm湿度敏感等级：1
专用输入次数：端子数量：160
最高工作温度：85 °C最低工作温度：-40 °C
组织：0 DEDICATED INPUTS输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：QFP
封装形状：SQUARE封装形式：FLATPACK
峰值回流温度（摄氏度）：225可编程逻辑类型：EE PLD
传播延迟：15 ns认证状态：Not Qualified
座面最大高度：3.97 mm标称供电电压：3 V
表面贴装：YES温度等级：INDUSTRIAL
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：28 mmBase Number Matches：1

ATF1516AS-15QI160 数据手册

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Features  
• High-density, High-performance, Electrically-erasable Complex  
Programmable Logic Device  
– 256 Macrocells  
– 5 Product Terms per Macrocell, Expandable up to 40 per Macrocell  
– 160, 192, 208 pins  
– 10 ns Maximum Pin-to-pin Delay  
– Registered Operation Up To 100 MHz  
– Enhanced Routing Resources  
• Flexible Logic Macrocell  
High-  
performance  
EE-based CPLD  
– D/T/Latch Configurable Flip-flops  
– Global and Individual Register Control Signals  
– Global and Individual Output Enable  
– Programmable Output Slew Rate  
– Programmable Output Open Collector Option  
– Maximum Logic Utilization by Burying a Register within a COM Output  
• Advanced Power Management Features  
– Automatic 3 mA Standby for “L” Version (Maximum)  
– Pin-controlled 4 mA Standby Mode (Typical)  
– Programmable Pin-keeper Inputs and I/Os  
– Reduced-power Feature per Macrocell  
• Available in Commercial and Industrial Temperature Ranges  
• Available in 160-lead PQFP, 192-pin PGA, and 208-lead RQFP Packages  
• Advanced EE Technology  
ATF1516AS  
ATF1516ASL  
– 100% Tested  
– Completely Reprogrammable  
– 10,000 Program/Erase Cycles  
Preliminary  
– 20 Year Data Retention  
– 2000V ESD Protection  
– 200 mA Latch-up Immunity  
• JTAG Boundary-scan Testing to IEEE Std. 1149.1-1990 and 1149.1a-1993 Supported  
• Fast In-System Programmability (ISP) via JTAG  
• PCI-compliant  
• 3.3 or 5.0V I/O Pins  
• Security Fuse Feature  
Enhanced Features  
• Improved Connectivity (Additional Feedback Routing, Alternate Input Routing)  
• Output Enable Product Terms  
• D-latch Mode  
• Combinatorial Output with Registered Feedback within Any Macrocell  
• Three Global Clock Pins  
• ITD (Input Transition Detection) Circuits on Global Clocks, Inputs and I/O  
• Fast Registered Input from Product Term  
• Programmable “Pin-keeper” Option  
• VCC Power-up Reset Option  
• Pull-up Option on JTAG Pins TMS and TDI  
• Advanced Power Management Features  
– Edge Controlled Power-down “L”  
– Individual Macrocell Power Option  
– Disable ITD on Global Clocks, Inputs and I/O  
Rev. 0994D–09/99  
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