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Datasheet > 驱动程序和接口 > 其他接口集成电路> ADUM6402ARWZ
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ADUM6402ARWZ

更新时间： 2024-02-05 11:00:29
品牌 Logo 应用领域
亚德诺 - ADI 转换器驱动程序和接口接口集成电路光电二极管
页数 文件大小 规格书
24页 594K
描述
Quad-Channel Isolators with Integrated DC-to-DC Converter

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ADUM6402ARWZ 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP,针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8543.70.99.60风险等级：5.58
接口集成电路类型：INTERFACE CIRCUITJESD-30 代码：R-PDSO-G16
JESD-609代码：e3长度：10.3 mm
湿度敏感等级：3功能数量：1
端子数量：16最高工作温度：105 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：2.65 mm
最大供电电压：5.5 V最小供电电压：3 V
标称供电电压：3.3 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：7.5 mmBase Number Matches：1

ADUM6402ARWZ 数据手册

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ADuM6400/ADuM6401/ADuM6402/ADuM6403/ADuM6404  
Table 4. Switching Specifications  
A Grade  
Typ  
C Grade  
Typ  
Parameter  
Symbol  
Min  
Max  
Min  
Max  
Unit  
Test Conditions  
SWITCHING SPECIFICATIONS  
Data Rate  
Propagation Delay  
Pulse Width Distortion  
Change vs. Temperature  
Pulse Width  
1
100  
40  
25  
60  
6
Mbps  
ns  
ns  
ps/°C  
ns  
ns  
Within PWD limit  
50% input to 50% output  
|tPLH − tPHL|  
tPHL, tPLH  
PWD  
55  
45  
5
PW  
tPSK  
1000  
40  
Within PWD limit  
Between any two units  
Propagation Delay Skew  
Channel Matching  
Codirectional1  
50  
15  
tPSKCD  
tPSKOD  
50  
50  
6
15  
ns  
ns  
Opposing Directional2  
1
7
Codirectional channel matching is the absolute value of the difference in propagation delays between any two channels with inputs on the same side of the  
isolation barrier.  
2 Opposing directional channel matching is the absolute value of the difference in propagation delays between any two channels with inputs on opposing sides of the  
isolation barrier.  
Table 5. Input and Output Characteristics  
Parameter  
Symbol Min  
Typ  
Max  
Unit  
Test Conditions  
DC SPECIFICATIONS  
Logic High Input Threshold  
Logic Low Input Threshold  
Logic High Output Voltages  
VIH  
VIL  
VOH  
0.7 VISO or 0.7 VDD1  
V
V
V
V
V
V
0.3 VISO or 0.3 VDD1  
VDD1 − 0.3 or VISO − 0.3 5.0  
VDD1 − 0.5 or VISO − 0.5 4.8  
IOx = −20 μA, VIx = VIxH  
IOx = −4 mA, VIx = VIxH  
IOx = 20 μA, VIx = VIxL  
IOx = 4 mA, VIx = VIxL  
VDD1, VDDL, VISO supply  
Logic Low Output Voltages  
VOL  
0.0  
0.2  
0.1  
0.4  
Undervoltage Lockout  
Positive Going Threshold  
Negative Going Threshold  
Hysterisis  
Input Currents per Channel  
AC SPECIFICATIONS  
Output Rise/Fall Time  
Common-Mode Transient  
Immunity1  
VUV+  
VUV−  
VUVH  
II  
2.7  
2.4  
0.3  
V
V
V
μA  
−20  
25  
+0.01 +20  
0 V ≤ VIx ≤ VDDX  
10% to 90%  
tR/tF  
|CM|  
2.5  
35  
ns  
kV/μs VIx= VDD1 or VISO, VCM = 1000 V,  
transient magnitude = 800 V  
Refresh Rate  
fr  
1.0  
Mbps  
1 |CM| is the maximum common-mode voltage slew rate that can be sustained while maintaining VO > 0.8 × VDD1 or 0.8 × VISO for a high input or VO < 0.8 × VDD1 or 0.8 × VISO for a  
low input. The common-mode voltage slew rates apply to both rising and falling common-mode voltage edges.  
Rev. 0 | Page 4 of 24  
 
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