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ADUM141D1BRWZ

更新时间： 2024-01-15 16:53:33

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亚德诺 - ADI		光电二极管
页数	文件大小	规格书
27页	693K
描述
3.0 kV RMS/3.75 kV RMS Quad Digital Isolators

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ADUM141D1BRWZ 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	包装说明：	SOP,
针数：	16	Reach Compliance Code：	compliant
风险等级：	2.09	其他特性：	IT ALSO OPERATES AT 2.5, 3.3, 5 V
模拟集成电路 - 其他类型：	ANALOG CIRCUIT	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e3	长度：	10.3 mm
湿度敏感等级：	3	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
座面最大高度：	2.65 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	1.7 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	温度等级：	AUTOMOTIVE
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7.5 mm
Base Number Matches：	1

ADUM141D1BRWZ 数据手册

Data Sheet

ADuM140D/ADuM140E/ADuM141D/ADuM141E/ADuM142D/ADuM142E

ELECTRICAL CHARACTERISTICS—3.3 V OPERATION

All typical specifications are at T_A= 25°C, V_DD1= V_DD2= 3.3 V. Minimum/maximum specifications apply over the entire recommended

operation range: 3.0 V ≤ V_DD1≤ 3.6 V, 3.0 V ≤ V_DD2≤ 3.6 V, and −40°C ≤ T_A≤ +125°C, unless otherwise noted. Switching specifications

are tested with C_L= 15 pF and CMOS signal levels, unless otherwise noted. Supply currents are specified with 50% duty cycle signals.

Table 3.

Parameter

Symbol Min

Typ

Max

Unit

Test Conditions/Comments

SWITCHING SPECIFICATIONS

Pulse Width

6.6

150

4.8

Mbps

ps/°C

Within PWD limit

50% input to 50% output

|t_PLH− t_PHL|

Data Rate¹

Propagation Delay

Pulse Width Distortion

Change vs. Temperature

Propagation Delay Skew

t_PHL, t_PLH

PWD

6.8

0.7

1.5

t_PSK

7.5

Between any two units at the same

temperature, voltage, and load

Channel Matching

Codirectional

Opposing Direction

Jitter

t_PSKCD

t_PSKOD

0.7

580

120

3.0

ps p-p

ps rms

See the Jitter Measurement section

DC SPECIFICATIONS

Input Threshold Voltage

Logic High

V_IH

V_IL

0.7 × V_DDx

Logic Low

0.3 × V_DDx

Output Voltage

Logic High

V_OH

V_OL

V_DDx− 0.1 V_DDx

V_DDx− 0.4 V_DDx− 0.2

I_Ox²= −20 μA, V_Ix= V_IxH

I_Ox²= −2 mA, V_Ix= V_IxH

Logic Low

0.0

0.2

0.1

0.4

I_Ox²= 20 μA, V_Ix= V_IxL

I_Ox²= 2 mA, V_Ix= V_IxL

Input Current per Channel

I_I

−10

+0.01

−3

+10

μA

0 V ≤ V_Ix≤ V_DDx

V_E2= 0 V

DISABLE₁= V_DDx

0 V ≤ V_Ox≤ V_DDx

V_E2Enable Input Pull-Up Current

DISABLE₁Input Pull-Down Current

Tristate Output Current per Channel

Quiescent Supply Current

I_PU

I_PD

I_OZ

+10

−10

+0.01

ADuM140D/ADuM140E

I_{DD1 (Q)}

I_{DD2 (Q)}

I_{DD1 (Q)}

I_{DD2 (Q)}

1.2

2.0

12.0

2.0

2.12

2.68

19.6

2.8

V_I⁵= 0 (E0, D0), 1 (E1, D1)⁶

V_I⁵= 1 (E0, D0), 0 (E1, D1)⁶

ADuM141D/ADuM141E

ADuM142D/ADuM142E

I_{DD1 (Q)}

I_{DD2 (Q)}

I_{DD1 (Q)}

I_{DD2 (Q)}

1.5

1.8

9.8

5.7

2.36

2.52

16.7

9.7

V_I⁵= 0 (E0, D0), 1 (E1, D1)⁶

V_I⁵= 1 (E0, D0), 0 (E1, D1)⁶

I_{DD1 (Q)}

I_{DD2 (Q)}

I_{DD1 (Q)}

I_{DD2 (Q)}

1.6

7.2

8.4

2.4

11.2

V_I⁵= 0 (E0, D0), 1 (E1, D1)⁶

V_I⁵= 1 (E0, D0), 0 (E1, D1)⁶

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