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Datasheet > 驱动程序和接口 > 其他接口集成电路> ADUM1400CRW
ADUM1400CRW PDF预览

ADUM1400CRW

更新时间： 2024-02-06 05:19:51
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
24页 1271K
描述
Quad-Channel Digital Isolators

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ADUM1400CRW 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：SOIC-16Reach Compliance Code：compliant
风险等级：5.56接口集成电路类型：INTERFACE CIRCUIT
JESD-30 代码：R-PDSO-G16长度：10.3 mm
功能数量：4端子数量：16
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED座面最大高度：2.65 mm
最大供电电压：5.5 V最小供电电压：3 V
标称供电电压：5 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mmBase Number Matches：1

ADUM1400CRW 数据手册

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ADuM1400/ADuM1401/ADuM1402  
Parameter  
Symbol  
Min  
Typ Max Unit  
Test Conditions  
SWITCHING SPECIFICATIONS  
ADuM140xARW  
Minimum Pulse Width3  
Maximum Data Rate4  
PW  
1000 ns  
Mbps  
100 ns  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
1
50  
Propagation Delay5  
tPHL, tPLH  
PWD  
tPSK  
65  
5
Pulse-Width Distortion, |tPLH – tPHL  
Propagation Delay Skew6  
Channel-to-Channel Matching7  
ADuM140xBRW  
|
40  
50  
50  
ns  
ns  
ns  
tPSKCD/OD  
Minimum Pulse Width3  
PW  
100 ns  
Mbps  
ns  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
Maximum Data Rate4  
10  
20  
Propagation Delay5  
tPHL, tPLH  
PWD  
32  
5
50  
3
5
Pulse-Width Distortion, |tPLH – tPHL  
Change vs. Temperature  
Propagation Delay Skew6  
Channel-to-Channel Matching,  
Codirectional Channels7  
|
ns  
ps/°C  
ns  
ns  
tPSK  
tPSKCD  
15  
3
Channel-to-Channel Matching,  
tPSKOD  
6
ns  
CL = 15 pF, CMOS signal levels  
Opposing-Directional Channels7  
ADuM140xCRW  
Minimum Pulse Width3  
Maximum Data Rate4  
PW  
8.3  
120  
27  
0.5  
3
11.1 ns  
Mbps  
ns  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
90  
18  
Propagation Delay5  
tPHL, tPLH  
PWD  
32  
2
5
Pulse-Width Distortion, |tPLH – tPHL  
Change vs. Temperature  
Propagation Delay Skew6  
Channel-to-Channel Matching,  
Codirectional Channels7  
|
ns  
ps/°C  
ns  
ns  
tPSK  
tPSKCD  
10  
2
Channel-to-Channel Matching,  
tPSKOD  
5
ns  
CL = 15 pF, CMOS signal levels  
Opposing-Directional Channels7  
For All Models  
Output Disable Propagation Delay  
(High/Low-to-High Impedance)  
Output Enable Propagation Delay  
(High Impedance to High/Low)  
Output Rise/Fall Time (10% to 90%)  
Common-Mode Transient Immunity  
at Logic High Output8  
t
PHZ, tPLH  
6
6
8
8
ns  
ns  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
CL = 15 pF, CMOS signal levels  
VIx = VDD1/VDD2, VCM = 1000 V,  
transient magnitude = 800 V  
VIx = 0 V, VCM = 1000 V,  
tPZH, tPZL  
tR/tF  
|CMH|  
2.5  
35  
ns  
kV/µs  
25  
25  
Common-Mode Transient Immunity  
at Logic Low Output8  
|CML|  
35  
kV/µs  
transient magnitude = 800 V  
Refresh Rate  
fr  
1.2  
Mbps  
Input Dynamic Supply Current, per Channel9  
Output Dynamic Supply Current, per Channel9  
IDDI (D)  
IDDO (D)  
0.19  
0.05  
mA/Mbps  
mA/Mbps  
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