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Datasheet > 驱动程序和接口 > 其他接口集成电路> ADUM1281WCRZ
ADUM1281WCRZ PDF预览

ADUM1281WCRZ

更新时间： 2024-01-26 13:47:54
品牌 Logo 应用领域
亚德诺 - ADI 驱动程序和接口接口集成电路光电二极管
页数 文件大小 规格书
20页 421K
描述
3 kV RMS Dual Channel Digital Isolators

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ADUM1281WCRZ 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP8,.25针数：8
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：2.11
Is Samacsys：N接口集成电路类型：INTERFACE CIRCUIT
JESD-30 代码：R-PDSO-G8长度：4.9 mm
功能数量：1端子数量：8
最高工作温度：125 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP8,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE座面最大高度：1.75 mm
最大供电电压：5.5 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL宽度：3.9 mm
Base Number Matches：1

ADUM1281WCRZ 数据手册

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Data Sheet  
ADuM1280/ADuM1281/ADuM1285/ADuM1286  
ELECTRICAL CHARACTERISTICS—3 V OPERATION (WA, WB, AND WC GRADES)  
All typical specifications are at TA = 25°C, VDD1 = VDD2 = 3.0 V. Minimum/maximum specifications apply over the entire recommended  
operation range: 3.0 V ≤ VDD1 ≤ 3.6 V, 3.0 V ≤ VDD2 ≤ 3.6 V, −40°C ≤ TA ≤ 125°C, unless otherwise noted. Switching specifications are  
tested with CL = 15 pF and CMOS signal levels, unless otherwise noted.  
Table 13.  
WA Grade  
Typ  
WB Grade  
Typ  
WC Grade  
Typ  
Parameter  
Symbol  
Min  
Min  
Min  
Max  
Min  
10  
Max  
Unit  
Test Conditions  
SWITCHING SPECIFICATIONS  
Pulse Width  
PW  
1000  
40  
Within PWD limit  
ns  
Data Rate  
1
25  
35  
3
Within PWD limit  
100  
33  
2.5  
Mbps  
ns  
ns  
ps/°C  
ns  
Propagation Delay  
Pulse Width Distortion  
Change vs. Temperature  
Propagation Delay Skew  
tPHL, tPLH  
PWD  
50  
10  
20  
50% input to 50% output  
25  
|tPLH − tPHL|  
7
2
3
2
1.5  
tPSK  
38  
16  
Between any two units at  
same operating conditions  
12  
Channel Matching  
Codirectional  
tPSKCD  
tPSKOD  
5
3
6
2.5  
5
ns  
ns  
ns  
Opposing-Direction  
10  
Jitter  
Codir ect ionalchannelm at chingis t heabs olut evalueof t hedif f er enceinpr opagat iondelays bet weenanyt wochannels wit hinp u t s o n t h e s a m e s id e o f t h e is o la t io n b a r r ie r .Op p o s in g - dir ect ionalchannelm at chingis t heabs olut evalueof t hedif f er enceinpr opagat iondelays bet weenanyt wochannels wit hinput s onoppos ings ides of t heis oal t ionbar r ier .  
1
7
Table 14.  
1 Mbps–WA, WB, WC  
Grades  
25 Mbps–WB, WC  
Grades  
100 Mbps–WC Grade  
Parameter  
Symbol  
Min  
Typ  
Min  
Min  
Typ  
Max  
Min  
Typ  
Max  
Unit  
Test Conditions  
SUPPLY CURRENT  
No load  
ADuM1280/ADuM1285  
ADuM1281/ADuM1286  
IDD1  
IDD2  
IDD1  
IDD2  
1.4  
3.5  
2.1  
2.3  
mA  
mA  
mA  
mA  
0.75  
2.0  
5.1  
2.7  
3.8  
3.9  
9.0  
4.6  
5.0  
6.2  
17  
4.8  
11  
11  
23  
9
1.6  
1.7  
15  
15  
Table 15. For All Models  
Parameter  
Symbol Min  
Typ  
Max  
Unit  
Test Conditions  
DC SPECIFICATIONS  
Logic High Input Threshold  
Logic Low Input Threshold  
Logic High Output Voltages  
VIH  
VIL  
0.7 VDDx  
V
0.3 VDDx  
V
VOH  
VDDx − 0.1  
VDDx − 0.4  
3.0  
V
IOx = −20 µA, VIx = VIxH  
IOx = −4 mA, VIx = VIxH  
IOx = 20 µA, VIx = VIxL  
IOx = 4 mA, VIx = VIxL  
0 V ≤ VIx ≤ VDDx  
2.8  
V
Logic Low Output Voltages  
VOL  
II  
0.0  
0.1  
0.4  
V
0.2  
V
Input Current per Channel  
Supply Current per Channel  
−10  
+0.01  
+10  
µA  
Quiescent Input Supply Current  
Quiescent Output Supply Current  
Dynamic Input Supply Current  
Dynamic Output Supply Current  
Undervoltage Lockout  
IDDI(Q)  
IDDO(Q)  
IDDI(D)  
0.4  
0.6  
1.7  
mA  
mA  
1.2  
0.08  
0.015  
mA/Mbps  
mA/Mbps  
IDDO(D)  
Positive VDDx Threshold  
VDDxUV+  
VDDxUV−  
VDDxUVH  
2.6  
2.4  
0.2  
V
V
V
Negative VDDx Threshold  
VDDX Hysteresis  
AC SPECIFICATIONS  
Output Rise/Fall Time  
tR/tF  
3
ns  
10% to 90%  
Common-Mode Transient Immunity1  
|CM|  
25  
35  
kV/µs  
VIx = VDDx, VCM = 1000 V,  
transient magnitude = 800 V  
Refresh Period  
tr  
1.6  
µs  
1 |CM| is the maximum common-mode voltage slew rate that can be sustained while maintaining Vo > 0.8 VDDX. The common-mode voltage slew rates apply to both  
rising and falling common-mode voltage edges.  
Rev. A | Page 7 of 20  
 
 
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