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ADT7461ARMZ PDF预览

ADT7461ARMZ

更新时间： 2024-01-09 14:09:43
品牌 Logo 应用领域
安森美 - ONSEMI 传感器换能器温度传感器光电二极管
页数 文件大小 规格书
20页 277K
描述
±1℃ Temperature Monitor with Series Resistance Cancellation

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ADT7461ARMZ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：SOIC
包装说明：LEAD FREE, MS-012-AA, SOIC-8针数：8
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5
模拟集成电路 - 其他类型：ANALOG CIRCUITJESD-30 代码：R-PDSO-G8
JESD-609代码：e3长度：4.9 mm
湿度敏感等级：1功能数量：1
端子数量：8最高工作温度：120 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
认证状态：Not Qualified座面最大高度：1.75 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：3.9 mmBase Number Matches：1

ADT7461ARMZ 数据手册

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ADT7461  
PIN ASSIGNMENT  
Pin No.  
Mnemonic  
Description  
1
2
3
4
V
Positive Supply, 3.0 V to 5.5 V.  
DD  
D+  
D−  
Positive Connection to Remote Temperature Sensor.  
Negative Connection to Remote Temperature Sensor.  
THERM  
Open−drain output that can be used to turn a fan on/off or throttle a CPU clock in the event of an  
overtemperature condition. Requires pullup to V  
.
DD  
5
6
GND  
Supply Ground Connection.  
ALERT/THERM2  
Open−Drain Logic Output Used as Interrupt or SMBus Alert. This may also be configured as a  
second THERM output. Requires pullup resistor.  
7
SDATA  
SCLK  
Logic Input/Output, SMBus Serial Data. Open−drain output. Requires pullup resistor.  
Logic Input, SMBus Serial Clock. Requires pullup resistor.  
8
SMBus TIMING SPECIFICATIONS (Note 1)  
Parameter  
Limit at T  
and T  
Unit  
kHz max  
ms min  
ms min  
ns max  
ns max  
ns min  
ns min  
ns min  
ns min  
ns min  
ms min  
Description  
MIN  
MAX  
f
t
400  
−
SCLK  
t
1.3  
0.6  
Clock low period, between 10% points.  
Clock high period, between 90% points.  
Clock/data rise time.  
LOW  
HIGH  
t
R
300  
300  
600  
600  
100  
300  
600  
1.3  
t
F
Clock/data fall time.  
t
Start condition setup time.  
Start condition hold time.  
SU; STA  
t
t
(Note 2)  
(Note 3)  
HD; STA  
SU; DAT  
Data setup time.  
t
Data hold time.  
HD; DAT  
t
(Note 4)  
Stop condition setup time.  
Bus free time between stop and start conditions.  
SU; STO  
t
BUF  
1. Guaranteed by design, but not production tested.  
2. Time from 10% of SDATA to 90% of SCLK.  
3. Time for 10% or 90% of SDATA to 10% of SCLK.  
4. Time for 90% of SCLK to 10% of SDATA.  
tR  
tF  
tHD;STA  
tLOW  
SCLK  
tHIGH  
tSU;DAT  
tSU;STA  
tHD;STA  
tHD;DAT  
tSU;STO  
SDATA  
tBUF  
STOP START  
START  
STOP  
Figure 2. Serial Bus Timing  
http://onsemi.com  
3
 
1234567...20

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