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ADT7460

更新时间： 2024-01-28 09:17:42
品牌 Logo 应用领域
亚德诺 - ADI 风扇控制器
页数 文件大小 规格书
48页 680K
描述
dB COOL?? Remote Thermal Controller and Fan Controller

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ADT7460 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：SSOP
包装说明：0.025 INCH PITCH, MO-137AB, QSOP-16针数：16
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.26
模拟集成电路 - 其他类型：ANALOG CIRCUITJESD-30 代码：R-PDSO-G16
JESD-609代码：e3长度：4.9 mm
湿度敏感等级：1功能数量：1
端子数量：16最高工作温度：120 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装等效代码：SSOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：3.3/5 V
认证状态：Not Qualified座面最大高度：1.7526 mm
子类别：Motion Control Electronics最大供电电流 (Isup)：3 mA
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：3.9116 mm

ADT7460 数据手册

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ADT7460  
Parameter  
Min  
Typ  
Max  
Unit  
Test Conditions/Comment  
DIGITAL INPUT LOGIC LEVELS  
(THERM)  
Input High Voltage, VIH  
Input Low Voltage, VIL  
Input High Voltage, VIH  
Input Low Voltage, VIL  
1.7  
0.8  
V
V
V
V
Bit 6 (THLD) Reg. 0x43 = 0  
(VID Threshold = 1 V)  
Bit 6 (THLD) Reg. 0x43 = 1  
(VID Threshold = 0.6 V)  
0.8  
0.4  
DIGITAL INPUT CURRENT  
Input High Current, IIH  
Input Low Current, IIL  
–1  
µA  
µA  
pF  
VIN = VCC  
VIN = 0  
+1  
Input Capacitance, CIN  
5
SERIAL BUS TIMING  
Clock Frequency, fSCLK  
Glitch Immunity, tSW  
10  
100  
50  
kHz  
ns  
µs  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
See Figure 1  
Can be optionally disabled  
Bus Free Time, tBUF  
4.7  
4.7  
4.0  
4.7  
4.0  
Start Setup Time, tSU;STA  
Start Hold Time, tHD;STA  
SCL Low Time, tLOW  
SCL High Time, tHIGH  
SCL, SDA Rise Time, tR  
SCL, SDA Fall Time, tF  
Data Setup Time, tSU;DAT  
Data Hold Time, tHD;DAT  
Detect Clock Low Timeout, tTIMEOUT  
µs  
µs  
µs  
50  
1000  
300  
µs  
ns  
µs  
250  
300  
15  
ns  
ns  
ms  
35  
NOTES  
1All voltages are measured with respect to GND, unless otherwise specified.  
2Typicals are at TA = 25°C and represent the most likely parametric norm.  
3Logic inputs will accept input high voltages up to VMAX even when the device is operating down to VMIN  
.
4Timing specifications are tested at logic levels of VIL = 0.8 V for a falling edge and VIH = 2.0 V for a rising edge.  
5The delay is the time between the round robin finishing one set of measurements and starting the next.  
Specifications subject to change without notice.  
tR  
tF  
tHD;STA  
tLOW  
SCL  
SDA  
tHIGH  
tSU;STA  
tSU;STO  
tHD;STA  
tHD;DAT  
tSU;DAT  
tBUF  
S
P
P
S
Figure 1. Diagram for Serial Bus Timing  
REV. 0  
–3–  
1234567...48

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