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ADM1490EBRZ-REEL7 PDF预览

ADM1490EBRZ-REEL7

更新时间： 2024-01-22 14:44:35
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
16页 343K
描述
16 Mbps, ESD Protected, Full-Duplex RS-485 Transceivers

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ADM1490EBRZ-REEL7 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP8,.25针数：8
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：1.37
差分输出：YES驱动器位数：1
输入特性：DIFFERENTIAL SCHMITT TRIGGER接口集成电路类型：LINE TRANSCEIVER
接口标准：EIA-422-B; TIA-422-B; EIA-485-A; TIA-485-AJESD-30 代码：R-PDSO-G8
JESD-609代码：e3长度：4.9 mm
湿度敏感等级：1功能数量：1
端子数量：8最高工作温度：85 °C
最低工作温度：-40 °C最小输出摆幅：1.5 V
最大输出低电流：0.004 A封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP8,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260电源：5 V
认证状态：Not Qualified最大接收延迟：20 ns
接收器位数：1座面最大高度：1.75 mm
子类别：Line Driver or Receivers最大压摆率：2 mA
最大供电电压：5.25 V最小供电电压：4.75 V
标称供电电压：5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
最大传输延迟：17 ns宽度：3.9 mm
Base Number Matches：1

ADM1490EBRZ-REEL7 数据手册

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ADM1490E/ADM1491E  
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS  
ADM1491E  
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
V
V
NC  
RO  
CC  
CC  
ADM1490E  
ADM1491E  
A
RE  
TOP VIEW  
(Not to Scale)  
B
DE  
RO  
RE  
1
2
3
4
5
10  
9
V
CC  
V
1
2
3
4
8
7
6
5
A
B
Z
CC  
Z
DI  
1
A
B
Z
RO  
DI  
TOP VIEW  
(Not to Scale)  
Y
GND  
GND  
DE  
8
TOP VIEW  
(Not to Scale)  
8
NC  
DI  
7
GND  
Y
GND  
6
Y
NC = NO CONNECT  
Figure 8. 14-Lead, Narrow Body SOIC  
Pin Configuration  
Figure 7. 8-Lead MSOP and 8-Lead SOIC  
Pin Configuration  
Figure 9. 10-Lead MSOP  
Pin Configuration  
Table 5. Pin Function Descriptions  
Pin No.  
8-Lead SOIC,  
8-Lead MSOP 14-Lead SOIC 10-Lead MSOP Mnemonic Description  
N/A1  
2
N/A1  
1
2
3
N/A1  
1
2
NC  
RO  
RE  
No Connect. This pin is available on the 14-lead SOIC only.  
Receiver Output.  
Receiver Output Enable. A low level enables the receiver output, whereas  
a high level places the receiver output in a high impedance state.  
Driver Output Enable. A logic high enables the differential driver outputs,  
A and B, whereas a logic low places the differential driver outputs in a  
high impedance state.  
Driver Input. When the driver is enabled, a logic low on DI forces Pin A low  
and Pin B high, whereas a logic high on DI forces Pin A high and Pin B low.  
N/A1  
4
5
3
4
DE  
DI  
3
4
6
7
8
9
5
GND  
GND  
NC  
Y
Ground.  
N/A1  
N/A1  
N/A1  
6
Ground. This pin is available on the 14-lead SOIC only.  
No Connect. This pin is available on the 14-lead SOIC only.  
Noninverting Driver Output Y.  
N/A1  
5
6
7
8
1
10  
11  
12  
13  
14  
7
8
9
10  
N/A1  
Z
B
A
VCC  
VCC  
Inverting Driver Output Z.  
Inverting Receiver Input B.  
Noninverting Receiver Input A.  
Power Supply (5 V 5ꢀ).  
N/A1  
Power Supply (5 V 5ꢀ). This pin is available on the 14-lead SOIC only.  
1 N/A indicates not applicable.  
Rev. B | Page 6 of 16  
 
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