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AD9953YSVZ

更新时间： 2024-01-05 03:32:24
品牌 Logo 应用领域
亚德诺 - ADI DSP外围设备微控制器和处理器外围集成电路PC时钟
页数 文件大小 规格书
32页 574K
描述
400 MSPS, 14-Bit, 1.8 V CMOS Direct Digital Synthesizer

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AD9953YSVZ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：TFQFP,针数：48
Reach Compliance Code：unknown风险等级：5.17
边界扫描：NO最大时钟频率：400 MHz
JESD-30 代码：S-PQFP-G48JESD-609代码：e3
长度：7 mm低功率模式：YES
湿度敏感等级：3端子数量：48
最高工作温度：105 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TFQFP
封装形状：SQUARE封装形式：FLATPACK, THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260认证状态：COMMERCIAL
座面最大高度：1.2 mm最大供电电压：1.89 V
最小供电电压：1.71 V标称供电电压：1.8 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：7 mmuPs/uCs/外围集成电路类型：DSP PERIPHERAL, NUMERIC CONTROLLED OSCILLATOR
Base Number Matches：1

AD9953YSVZ 数据手册

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400 MSPS, 14-Bit, 1.8 V CMOS  
Direct Digital Synthesizer  
AD9953  
PLL REFCLK multiplier (4× to 20×)  
Internal oscillator, can be driven by a single crystal  
Phase modulation capability  
FEATURES  
400 MSPS internal clock speed  
Integrated 14-bit DAC  
32-bit tuning word  
Multichip synchronization  
Phase noise ≤ –120 dBc/Hz @ 1 kHz offset (DAC output)  
Excellent dynamic performance  
>80 dB SFDR @ 160 MHz ( 100 kHz offset) AOUT  
Serial I/O control  
1.8 V power supply  
Software and hardware controlled power-down  
48-lead TQFP/EP package  
APPLICATIONS  
Agile VHF/UHF LO frequency synthesis  
FM chirp source for radar and scanning systems  
Nonlinear-shaped PSK/FSK modulator  
Test and measurement equipment  
Support for 5 V input levels on most digital inputs  
FUNCTIONAL BLOCK DIAGRAM  
DDS CORE  
AD9953  
PHASE  
ACCUMULATOR  
RAM  
DATA  
1024 × 32  
STATIC RAM  
DAC_R  
PHASE  
OFFSET  
SET  
M
U
X
32  
–1  
Z
IOUT  
IOUT  
19  
14  
COS(X)  
DAC  
SYSTEM  
CLOCK  
14  
–1  
Z
MUX  
SYNC_IN  
3
32  
PHASE  
OFFSET  
WORD  
32  
14  
14  
10  
RAM DATA <31:18>  
OSK  
TIMING AND CONTROL LOGIC  
I/O UPDATE  
SYNC_CLK  
PWRDWNCTL  
0
M
U
X
SYNC  
CONTROL REGISTERS  
÷ 4  
OSCILLATOR/BUFFER  
M
U
X
SYSTEM  
CLOCK  
4×–20×  
CLOCK  
MULTIPLIER  
REFCLK  
REFCLK  
ENABLE  
CRYSTAL OUT  
PS<1:0> I/O PORT  
RESET  
Figure 1.  
Rev. A  
Information furnished by Analog Devices is believed to be accurate and reliable. However, no  
responsibility is assumed by Analog Devices for its use, nor for any infringements of patents or other  
rights of third parties that may result from its use. Specifications subject to change without notice. No  
license is granted by implication or otherwise under any patent or patent rights of Analog Devices.  
Trademarks and registeredtrademarks arethe property of their respective owners.  
One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106, U.S.A.  
Tel: 781.329.4700 www.analog.com  
Fax: 781.461.3113 ©2004–2009 Analog Devices, Inc. All rights reserved.  
 
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