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AD9927BBCZ

更新时间： 2024-02-21 12:08:00
品牌 Logo 应用领域
亚德诺 - ADI 驱动器
页数 文件大小 规格书
100页 832K
描述
14-Bit CCD Signal Processor with V-Driver and Precision TimingTM Generator

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AD9927BBCZ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：BGA
包装说明：9 X 9 MM, LEAD FREE, MO-225, CSP_BGA-128针数：128
Reach Compliance Code：unknown风险等级：5.66
商用集成电路类型：CONSUMER CIRCUITJESD-30 代码：S-XBGA-B128
JESD-609代码：e1长度：9 mm
湿度敏感等级：3功能数量：1
端子数量：128最高工作温度：85 °C
最低工作温度：-25 °C封装主体材料：UNSPECIFIED
封装代码：LFBGA封装形状：SQUARE
封装形式：GRID ARRAY, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
认证状态：COMMERCIAL座面最大高度：1.4 mm
最大供电电压 (Vsup)：2 V最小供电电压 (Vsup)：1.6 V
表面贴装：YES温度等级：OTHER
端子面层：TIN SILVER COPPER端子形式：BALL
端子节距：0.65 mm端子位置：BOTTOM
处于峰值回流温度下的最长时间：40宽度：9 mm
Base Number Matches：1

AD9927BBCZ 数据手册

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AD9927  
SPECIFICATIONS  
Table 1.  
Parameter  
Min  
Typ  
Max  
Unit  
TEMPERATURE RANGE  
Operating  
Storage  
−25  
−65  
+85  
+150  
°C  
°C  
POWER SUPPLY VOLTAGE INPUTS  
AVDD (AFE Analog Supply)  
TCVDD (Timing Core Supply)  
CLIVDD (CLI Input Supply)  
RGVDD (RG, HL Driver)  
HVDD (H1 to H8 Drivers)  
DVDD (Digital Logic)  
DRVDD (Parallel Data Output Drivers)  
IOVDD (Digital I/O)  
XVVDD (Vertical Output Drivers)  
CP1P8 (CP Supply Input)  
LDOIN (LDO Supply Input)  
V-DRIVER POWER SUPPLY VOLTAGES  
VDD1, VDD2 (V-Driver Logic)  
VH1, VH2 (V-Driver High Supply)  
VL1, VL2 (V-Driver Low Supply)  
VM1, VM2 (V-Driver Mid Supply)  
VLL (SUBCK Low Supply)  
1.6  
1.6  
1.6  
2.7  
2.7  
1.6  
1.6  
2.7  
2.7  
1.6  
2.25  
1.8  
1.8  
3.0  
3.0  
3.0  
1.8  
3.0  
3.0  
3.0  
1.8  
3.0  
2.0  
2.0  
3.6  
3.6  
3.6  
2.0  
3.6  
3.6  
3.6  
2.0  
3.6  
V
V
V
V
V
V
V
V
V
V
V
2.7  
3.0  
3.6  
V
V
V
V
V
V
11.5  
−8.5  
−1.5  
−8.5  
−4.0  
15.0  
−7.5  
0.0  
−7.5  
0.0  
16.5  
−5.5  
+1.5  
−5.5  
+0.3  
VMM (SUBCK Mid Supply)  
POWER SUPPLY CURRENTS—40 MHz OPERATION  
AVDD (1.8 V)  
TCVDD (1.8 V)  
27  
5
mA  
mA  
mA  
mA  
mA  
mA  
mA  
mA  
mA  
CLIVDD (3 V)  
1.5  
10  
59  
9.5  
6
RGVDD (3.3 V, 20 pF RG Load, 20 pF HL Load)  
HVDD1 (3.3 V, 480 pF Total Load on H1 to H8)  
DVDD (1.8 V)  
DRVDD (3 V, 10 pF Load on Each DOUT Pin)  
IOVDD (3 V, Depends on Load and Output Frequency of Digital I/O)  
XVVDD (3 V, Depends on Load and Output Frequency of XV Signals)  
POWER SUPPLY CURRENTS—STANDBY MODE OPERATION  
Standby1 Mode  
2
2
12  
5
1.5  
mA  
mA  
mA  
MHz  
Standby2 Mode  
Standby3 Mode  
MAXIMUM CLOCK RATE (CLI)  
40  
1 The total power dissipated by the HVDD (or RGVDD) supply can be approximated using the equation  
Total HVDD Power = [CL × HVDD × Pixel Frequency] × HVDD  
Reducing the capacitive load and/or reducing the HVDD supply reduces the power dissipation. CL is the total capacitance seen by all H-outputs.  
Rev. 0 | Page 3 of 100  
 
1234567...100

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