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AD9826

更新时间： 2024-02-14 21:43:06
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
20页 158K
描述
Complete 16-Bit Imaging Signal Processor

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AD9826 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active零件包装代码：SSOP
包装说明：5.30 MM, SSOP-28针数：28
Reach Compliance Code：unknown风险等级：5.63
Is Samacsys：N其他特性：IT ALSO REQUIRES 3V TO 5.25V DIGITAL SUPPLY
商用集成电路类型：CONSUMER CIRCUITJESD-30 代码：R-PDSO-G28
JESD-609代码：e3长度：10.2 mm
湿度敏感等级：1功能数量：1
端子数量：28最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：260
认证状态：COMMERCIAL座面最大高度：2 mm
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：5.3 mmBase Number Matches：1

AD9826 数据手册

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AD9826  
P IN CO NFIGURATIO N  
CDSCLK1  
CDSCLK2  
ADCCLK  
OEB  
1
2
3
4
5
6
7
8
9
28 AVDD  
AVSS  
27  
26 VINR  
25 OFFSET  
24 VING  
23 CML  
DRVDD  
DRVSS  
(MSB) D7  
D6  
AD9826  
TOP VIEW  
22 VINB  
(Not to Scale) 21 CAPT  
D5  
20  
CAPB  
D4 10  
19 AVSS  
11  
12  
13  
14  
18  
D3  
D2  
AVDD  
17  
SLOAD  
16  
15  
D1  
SCLK  
(LSB) D0  
SDATA  
P IN FUNCTIO N D ESCRIP TIO NS  
P in No.  
Mnem onic  
Type  
D escription  
1
CDSCLK1  
CDSCLK2  
ADCCLK  
OEB  
DI  
CDS Reference Level Sampling Clock  
CDS Data Level Sampling Clock  
A/D Converter Sampling Clock  
Output Enable, Active Low  
2
DI  
3
DI  
4
DI  
5
DRVDD  
DRVSS  
D7  
P
Digital Output Driver Supply  
Digital Output Driver Ground  
6
P
7
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DO  
DI/DO  
DI  
Data Output MSB. ADC DB15 High Byte, ADC DB7 Low Byte  
Data Output. ADC DB14 High Byte, ADC DB6 Low Byte  
Data Output. ADC DB13 High Byte, ADC DB5 Low Byte  
Data Output. ADC DB12 High Byte, ADC DB4 Low Byte  
Data Output. ADC DB11 High Byte, ADC DB3 Low Byte  
Data Output. ADC DB10 High Byte, ADC DB2 Low Byte  
Data Output. ADC DB9 High Byte, ADC DB1 Low Byte  
Data Output LSB. ADC DB8 High Byte, ADC DB0 Low Byte  
Serial Interface Data Input/Output  
8
D6  
9
D5  
10  
11  
12  
13  
14  
15  
16  
17  
18, 28  
19, 27  
20  
21  
22  
23  
24  
25  
26  
D4  
D3  
D2  
D1  
D0  
SDAT A  
SCLK  
SLOAD  
AVDD  
AVSS  
CAPB  
CAPT  
VINB  
CML  
Serial Interface Clock Input  
DI  
Serial Interface Load Pulse  
P
5 V Analog Supply  
P
Analog Ground  
AO  
AO  
AI  
ADC Bottom Reference Voltage Decoupling  
ADC T op Reference Voltage Decoupling  
Analog Input, Blue Channel  
AO  
AI  
Internal Bias Level Decoupling  
VING  
OFFSET  
VINR  
Analog Input, Green Channel  
AO  
AI  
Clamp Bias Level Decoupling  
Analog Input, Red Channel  
T YPE: AI = Analog Input, AO = Analog Output, DI = Digital Input, DO = Digital Output, P = Power.  
REV. A  
–5–  
12345678...20

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