AD8402ARZ1

更新时间： 2024-02-06 22:59:34

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亚德诺 - ADI		转换器电位器数字电位计电阻器光电二极管 PC
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1-/2-/4-Channel Digital Potentiometers

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AD8402ARZ1 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	14
Reach Compliance Code：	unknown	风险等级：	5.71
Is Samacsys：	N	其他特性：	IT CAN ALSO OPERATE FROM A 5V NOMINAL SUPPLY
标称带宽：	5 kHz	控制接口：	3-WIRE SERIAL
转换器类型：	DIGITAL POTENTIOMETER	JESD-30 代码：	R-PDSO-G14
JESD-609代码：	e3	长度：	8.65 mm
湿度敏感等级：	1	功能数量：	2
位置数：	256	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	COMMERCIAL
电阻定律：	LINEAR	最大电阻器端电压：	5.5 V
最小电阻器端电压：		座面最大高度：	1.75 mm
标称供电电压：	3 V	表面贴装：	YES
标称温度系数：	700 ppm/ °C	温度等级：	AUTOMOTIVE
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	标称总电阻：	1000 Ω
宽度：	3.9 mm	Base Number Matches：	1

AD8402ARZ1 数据手册

AD8400/AD8402/AD8403

Parameter

DYNAMIC CHARACTERISTICS^{6, 10}

Symbol

Conditions

Min

Typ¹

Max

Unit

Bandwidth −3 dB

BW_50 K

BW_100 K

THD_W

R = 50 kΩ

R = 100 kΩ

V_A= 1 V rms + 2 V dc, V_B= 2 V dc, f = 1 kHz

V_A= V_DD, V_B= 0 V, 1% error band

125

0.003

kHz

μs

nVꢀ√Hz

Total Harmonic Distortion

V_WSettling Time

t_S_50 K

t_S_100 K

e_NWB_50 K

e_NWB_100 K

C_T

Resistor Noise Voltage

Crosstalk¹¹

R_WB= 25 kΩ, f = 1 kHz, = 0

R_WB= 50 kΩ, f = 1 kHz, = 0

V_A= V_DD, V_B= 0 V

−65

¹Typicals represent average readings at 25°C and V_DD= 5 V.

²Resistor position nonlinearity error R-INL is the deviation from an ideal value measured between the maximum resistance and the minimum resistance wiper

positions. R-DNL measures the relative step change from ideal between successive tap positions. Parts are guaranteed monotonic. See the test circuit in Figure 38.

I_W= V_DDꢀR for V_DD= 3 V or 5 V for the 50 kΩ and 100 kΩ versions.

³V_AB= V_DD, wiper (V_W) = no connect.

⁴INL and DNL are measured at VW with the RDAC configured as a potentiometer divider similar to a voltage output DꢀA converter. V_A= V_DDand V_B= 0 V.

DNL specification limits of 1 LSB maximum are guaranteed monotonic operating conditions. See the test circuit in Figure 37.

⁵Resistor Terminal A, Resistor Terminal B, and Resistor Terminal W have no limitations on polarity with respect to each other.

⁶Guaranteed by design and not subject to production test. Resistor-terminal capacitance tests are measured with 2.5 V bias on the measured terminal. The remaining

resistor terminals are left open circuit.

⁷Measured at the Ax terminals. All Ax terminals are open-circuited in shutdown mode.

⁸Worst-case supply current consumed when input logic level at 2.4 V, standard characteristic of CMOS logic. See Figure 28 for a plot of I_DDvs. logic voltage.

⁹P_DISSis calculated from (I_DD× V_DD). CMOS logic level inputs result in minimum power dissipation.

¹⁰All dynamic characteristics use V_DD= 5 V.

¹¹Measured at a V_Wpin where an adjacent V_Wpin is making a full-scale voltage change.

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