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Datasheet > 转换器 > 数字电位计> AD8402ARU50-REEL
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AD8402ARU50-REEL

更新时间： 2024-02-28 14:54:41
品牌 Logo 应用领域
亚德诺 - ADI 转换器电位器数字电位计电阻器光电二极管
页数 文件大小 规格书
32页 610K
描述
1-/2-/4-Channel Digital Potentiometers

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AD8402ARU50-REEL 技术参数

Source Url Status Check Date：2013-05-01 14:56:26.274是否无铅： 含铅
是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：1.10 MM, MO-153AB-1, TSSOP-14
针数：14Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.6Is Samacsys：N
其他特性：IT CAN ALSO OPERATE FROM A 5V NOMINAL SUPPLY标称带宽：0.125 kHz
控制接口：3-WIRE SERIAL转换器类型：DIGITAL POTENTIOMETER
JESD-30 代码：R-PDSO-G14JESD-609代码：e0
长度：5 mm湿度敏感等级：1
功能数量：2位置数：256
端子数量：14最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP14,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：240电源：3/5 V
认证状态：Not Qualified电阻定律：LINEAR
最大电阻器端电压：5.5 V最小电阻器端电压：
座面最大高度：1.2 mm子类别：Digital Potentiometers
标称供电电压：3 V表面贴装：YES
技术：CMOS标称温度系数：500 ppm/ °C
温度等级：AUTOMOTIVE端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
标称总电阻：50000 Ω宽度：4.4 mm
Base Number Matches：1

AD8402ARU50-REEL 数据手册

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AD8400/AD8402/AD8403  
Parameter  
DYNAMIC CHARACTERISTICS6, 10  
Symbol  
Conditions  
Min  
Typ1  
Max  
Unit  
Bandwidth −3 dB  
BW_50 K  
BW_100 K  
THDW  
R = 50 kΩ  
R = 100 kΩ  
VA = 1 V rms + 2 V dc, VB = 2 V dc, f = 1 kHz  
VA = VDD, VB = 0 V, 1% error band  
VA = VDD, VB = 0 V, 1% error band  
125  
71  
0.003  
9
18  
20  
kHz  
kHz  
%
μs  
μs  
nVꢀ√Hz  
nVꢀ√Hz  
dB  
Total Harmonic Distortion  
VW Settling Time  
tS_50 K  
tS_100 K  
eNWB_50 K  
eNWB_100 K  
CT  
Resistor Noise Voltage  
Crosstalk11  
RS  
RWB = 25 kΩ, f = 1 kHz, = 0  
RS  
29  
RWB = 50 kΩ, f = 1 kHz, = 0  
VA = VDD, VB = 0 V  
−65  
1 Typicals represent average readings at 25°C and VDD = 5 V.  
2 Resistor position nonlinearity error R-INL is the deviation from an ideal value measured between the maximum resistance and the minimum resistance wiper  
positions. R-DNL measures the relative step change from ideal between successive tap positions. Parts are guaranteed monotonic. See the test circuit in Figure 38.  
IW = VDDꢀR for VDD = 3 V or 5 V for the 50 kΩ and 100 kΩ versions.  
3 VAB = VDD, wiper (VW) = no connect.  
4 INL and DNL are measured at VW with the RDAC configured as a potentiometer divider similar to a voltage output DꢀA converter. VA = VDD and VB = 0 V.  
DNL specification limits of 1 LSB maximum are guaranteed monotonic operating conditions. See the test circuit in Figure 37.  
5 Resistor Terminal A, Resistor Terminal B, and Resistor Terminal W have no limitations on polarity with respect to each other.  
6 Guaranteed by design and not subject to production test. Resistor-terminal capacitance tests are measured with 2.5 V bias on the measured terminal. The remaining  
resistor terminals are left open circuit.  
7 Measured at the Ax terminals. All Ax terminals are open-circuited in shutdown mode.  
8 Worst-case supply current consumed when input logic level at 2.4 V, standard characteristic of CMOS logic. See Figure 28 for a plot of IDD vs. logic voltage.  
9 PDISS is calculated from (IDD × VDD). CMOS logic level inputs result in minimum power dissipation.  
10 All dynamic characteristics use VDD = 5 V.  
11 Measured at a VW pin where an adjacent VW pin is making a full-scale voltage change.  
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