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AD73360ASU

更新时间： 2024-02-20 02:20:23

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亚德诺 - ADI		/
页数	文件大小	规格书
35页	280K
描述
Six-Input Channel Analog Front End

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AD73360ASU 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	28
Reach Compliance Code：	unknown	风险等级：	5.6
JESD-30 代码：	R-PDSO-G28	JESD-609代码：	e3
长度：	17.9 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	28
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	COMMERCIAL
座面最大高度：	2.65 mm	标称供电电压：	3.3 V
表面贴装：	YES	电信集成电路类型：	TELECOM CIRCUIT
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	40
宽度：	7.5 mm	Base Number Matches：	1

AD73360ASU 数据手册

AD73360

t₁

t₂

t₃

Figure 1. MCLK Timing

100␮A

–10

–85 –75

–65

–55

–45

–35

–25

–15

–5

TO OUTPUT

3.17

– dBm0

+2.1V

15pF

Figure 5a. S/(N+D) vs. V_IN(ADC @ 3 V) Over Voiceband

Bandwidth (300 Hz–3.4 kHz)

100␮A

Figure 2. Load Circuit for Timing Specifications

t₂

t₁

t₃

MCLK

SCLK*

t₁₃

t₅

t₆

t₄

* SCLK IS INDIVIDUALLY PROGRAMMABLE

IN FREQUENCY (MCLK/4 SHOWN HERE).

–10

–85

–75

–65

–55

–45

–35

–25

–15

–5

3.17

– dBm0

Figure 3. SCLK Timing

Figure 5b. S/(N+D) vs. V_IN(ADC @ 5 V) Over Voiceband

Bandwidth (300 Hz–3.4 kHz)

SE (I)

THREE-

STATE

SCLK (O)

SDIFS (I)

t₇

t₈

t₇

SDI (I)

D15

D14

D15

t₉

t₁₀

THREE-

STATE

SDOFS (O)

t₁₁

t₁₂

THREE-

STATE

SDO (O)

D15

D14

Figure 4. Serial Port (SPORT)

REV. A

–7–

1...4 5 678 9 10...35

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