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AD73360

更新时间： 2024-01-03 08:53:27

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亚德诺 - ADI		/
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35页	280K
描述
Six-Input Channel Analog Front End

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AD73360 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	28
Reach Compliance Code：	unknown	风险等级：	5.6
JESD-30 代码：	R-PDSO-G28	JESD-609代码：	e3
长度：	17.9 mm	湿度敏感等级：	3
功能数量：	1	端子数量：	28
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	260	认证状态：	COMMERCIAL
座面最大高度：	2.65 mm	标称供电电压：	3.3 V
表面贴装：	YES	电信集成电路类型：	TELECOM CIRCUIT
温度等级：	INDUSTRIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	40
宽度：	7.5 mm	Base Number Matches：	1

AD73360 数据手册

AD73360

AD73360A

Typ

Parameter

Min

Max

Unit

Test Conditions/Comments

LOGIC INPUTS

V_INH, Input High Voltage

V_DD– 0.8

V_DD

0.8

µA

_INL, Input Low Voltage

I_IH, Input Current

C_IN, Input Capacitance

LOGIC OUTPUTS

V_OH, Output High Voltage

V_OL, Output Low Voltage

Three-State Leakage Current

V_DD– 0.4

–10

V_DD

0.4

+10

µA

|IOUT| ≤ 100 µA

POWER SUPPLIES

AVDD1, AVDD2

DVDD

2.7

3.3

I_DD

See Table I

NOTES

¹Operating temperature range is as follows: –40°C to +85°C. Therefore, T_MIN= –40°C and T_MAX= +85°C.

²Test conditions: Input PGA set for 0 dB gain (unless otherwise noted).

³At input to sigma-delta modulator of ADC.

⁴Guaranteed by design.

⁵Overall group delay will be affected by the sample rate and the external digital filtering.

⁶The ADC’s input impedance is inversely proportional to DMCLK and is approximated by: (4 × 10¹¹)/DMCLK.

⁷Frequency response of ADC measured with input at audio reference level (the input level that produces an output level of –10 dBm0), with 38 dB preamplifier

bypassed and input gain of 0 dB.

⁸Test Conditions: no load on digital inputs, analog inputs ac coupled to ground.

Specifications subject to change without notice.

Table I. Current Summary (AVDD = DVDD = 3.3 V)

Total

Analog

Current

Digital

Current

(Max)

MCLK

Conditions

Current

Comments

ADCs Only On

REFCAP Only On

REFCAP and

0.75

0.04

26.5

1.0

YES

REFOUT Disabled

REFOUT Only On 3.3

0.04

1.2

0.03

4.5

1.5

0.1

YES

All Sections Off

0.01

MCLK Active Levels Equal to 0 V and DVDD

Digital Inputs Static and Equal to 0 V or DVDD

The above values are in mA and are typical values unless otherwise noted. MCLK = 16.384 MHz; SCLK = 16.384 MHz.

REV. A

–3–

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