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AD5940BCBZ-RL

更新时间: 2024-01-06 06:37:00
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亚德诺 - ADI /
页数 文件大小 规格书
130页 1952K
描述
High Precision, Impedance, and Electrochemical Front End

AD5940BCBZ-RL 技术参数

是否无铅: 含铅是否Rohs认证: 符合
生命周期:Active包装说明:WLCSP-56
针数:56Reach Compliance Code:compliant
风险等级:5.81模拟集成电路 - 其他类型:ANALOG CIRCUIT
JESD-30 代码:R-PBGA-B56长度:4.16 mm
功能数量:1端子数量:56
最高工作温度:85 °C最低工作温度:-40 °C
封装主体材料:PLASTIC/EPOXY封装代码:VFBGA
封装形状:RECTANGULAR封装形式:GRID ARRAY, VERY THIN PROFILE, FINE PITCH
座面最大高度:0.55 mm最大供电电压 (Vsup):3.6 V
最小供电电压 (Vsup):2.8 V标称供电电压 (Vsup):3.3 V
表面贴装:YES温度等级:INDUSTRIAL
端子形式:BALL端子节距:0.4 mm
端子位置:BOTTOM宽度:3.56 mm

AD5940BCBZ-RL 数据手册

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AD5940  
Data Sheet  
FUNCTIONAL BLOCK DIAGRAM  
VREF_2V5 VREF_1V82 AVDD_REG AVDD AGND_REF XTALI XTALO  
AGND  
VREF_2V5  
V
BIAS  
0.92V INTERNAL  
RCAL0  
RCAL1  
CE0  
+
AMP  
HP  
DUAL  
PRECISION  
V
BIAS  
OUTPUTS  
BUF  
REFERENCE  
V
16MHz/32MHz  
XTAL  
DRIVER  
OSC  
POR  
12-BIT  
VDAC  
ZERO  
REF  
BUF  
RE0  
V
0.92V  
LP REF  
BIAS0  
CE0  
LP  
BUF  
LPF0  
+
V
ZERO  
1.8V LP 1.8V HP  
LPTIA  
LDO  
LDO  
SE0  
MISO  
MOSI  
SCLK  
CS  
RE0  
R
TIA0  
V
ZERO0  
SE0  
R
GAIN 1/1.5/  
2/4/9  
fC = 50kHz/100kHz/  
250kHz  
TIA0  
SPI  
1.8V  
DE0  
16-BIT ADC  
160kSPS/  
400kSPS  
AVDD/2  
VDE0  
RC0_0  
RC0_1  
BUF  
PGA  
BUF  
AAF  
LOW BANDWIDTH AFE LOOP  
RC0_0  
RC0_1  
RC0_2  
V
ZERO0  
GPIO0  
GPIO1  
GPIO2  
GPIO3  
GPIO4  
GPIO5  
GPIO6  
GPIO7  
V
BIAS0  
COARSE OFFSET  
CORRECTION  
VREF_1V82  
RCF  
V
DACP  
EXCITATION DACN  
+
12-BIT  
VDAC  
AIN0  
AIN1  
AIN2  
VCE0  
VRE0  
CE0  
ADC FIFO  
AND MMR  
AMPLIFIER  
LOOP  
P
N
WAVEFORM  
GENERATOR  
BIAS  
DFT  
V
ZERO  
AIN0  
AINx  
RE0  
AIN3/BUF_VREF1V8  
AIN4/LPF0  
AIN6  
CLOCK  
GENERATOR  
DIGITAL  
FILTERS  
16MHz  
OSC  
COMMAND  
FIFO  
V
ZERO  
+
R
R
LOAD02  
LOAD03  
HPTIA  
T
VREF_2V5/2  
VREF_1V82  
SE0  
DE0  
AFE1  
AFE2  
AFE3  
AFE4  
32kHz  
OSC  
WAKE-UP  
TIMER  
SEQUENCER  
DNC  
DNC  
DNC  
INTERRUPT  
GENERATOR  
R
GPIO  
CRC  
TIA2  
HIGH BANDWIDTH AFE LOOP  
TEMPERATURE  
SENSOR  
DIGITAL  
VBIAS_CAP  
AD5940  
DVD_REG_1V8  
DGND DVDD  
RESET IOVDD  
Figure 2.  
Rev. 0 | Page 4 of 130  
 

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