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AD5243BRM2.5-R2

更新时间： 2024-01-18 23:32:56

品牌	Logo	应用领域
亚德诺 - ADI		光电二极管转换器电阻器
页数	文件大小	规格书
16页	852K
描述
IC 2.5K DIGITAL POTENTIOMETER, 2-WIRE SERIAL CONTROL INTERFACE, 256 POSITIONS, PDSO10, 3 X 4.90 MM, MO-187BA, MSOP-10, Digital Potentiometer

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AD5243BRM2.5-R2 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	3 X 4.90 MM, MO-187BA, MSOP-10	针数：	10
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.5
其他特性：	IT CAN ALSO OPERATE FROM A 5V NOMINAL SUPPLY	标称带宽：	2.4 kHz
控制接口：	2-WIRE SERIAL	转换器类型：	DIGITAL POTENTIOMETER
JESD-30 代码：	S-PDSO-G10	JESD-609代码：	e0
长度：	3 mm	功能数量：	1
位置数：	256	端子数量：	10
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP10,.19,20	封装形状：	SQUARE
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3/5 V	认证状态：	Not Qualified
电阻定律：	LINEAR	最大电阻容差：	30%
最大电阻器端电压：	3 V	最小电阻器端电压：
座面最大高度：	1.1 mm	子类别：	Digital Potentiometers
标称供电电压：	3 V	表面贴装：	YES
标称温度系数：	35 ppm/ °C	温度等级：	AUTOMOTIVE
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	标称总电阻：	2500 Ω
宽度：	3 mm

AD5243BRM2.5-R2 数据手册

AD5243/AD5248

Preliminary Technical Data

device should be bypassed with disc or chip ceramic capacitors

of 0.01 µF to 0.1 µF. Low ESR 1 µF to 10 µF tantalum or

electrolytic capacitors should also be applied at the supplies to

minimize any transient disturbance and low frequency ripple

(see Figure 23). Note that the digital ground should also be

joined remotely to the analog ground at one point to minimize

the ground bounce.

POWER-UP SEQUENCE

Since the ESD protection diodes limit the voltage compliance at

terminals A, B, and W (see Figure 22), it is important to power

V_DD/GND before applying any voltage to terminals A, B, and Wꢀ

otherwise, the diode will be forward biased such that V_DDwill be

powered unintentionally and may affect the rest of the user’s

circuit. The ideal power-up sequence is in the following order:

GND, V_DD, digital inputs, and then V_A/B/W. The relative order of

powering V_A, V_B, V_W, and the digital inputs is not important as

long as they are powered after V_DD/GND.

10 F

0.1 F

AD5243

LAYOUT AND POWER SUPPLY BYPASSING

GND

It is a good practice to employ compact, minimum lead length

layout design. The leads to the inputs should be as direct as

possible with a minimum conductor length. Ground paths

should have low resistance and low inductance.

Figure 23. Power Supply Bypassing

Similarly, it is also a good practice to bypass the power supplies

with quality capacitors for optimum stability. Supply leads to the

Rev. PrE 5/12/03 | Page 13 of 16

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