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80524RX500128

更新时间： 2024-02-17 00:38:32

品牌	Logo	应用领域
英特尔 - INTEL		时钟外围集成电路
页数	文件大小	规格书
86页	951K
描述
Microprocessor, 32-Bit, 500MHz, CMOS, PPGA370, 1.950 X 1.950 INCH, STAGGERED, PLASTIC, PGA-370

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80524RX500128 技术参数

生命周期：	Obsolete	零件包装代码：	PGA
包装说明：	IPGA,	针数：	370
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.3
HTS代码：	8542.31.00.01	风险等级：	5.83
地址总线宽度：	32	位大小：	32
边界扫描：	YES	最大时钟频率：	500 MHz
外部数据总线宽度：	64	格式：	FLOATING POINT
集成缓存：	YES	JESD-30 代码：	S-PPGA-P370
长度：	49.53 mm	低功率模式：	YES
端子数量：	370	封装主体材料：	PLASTIC/EPOXY
封装代码：	IPGA	封装形状：	SQUARE
封装形式：	GRID ARRAY, INTERSTITIAL PITCH	认证状态：	Not Qualified
座面最大高度：	3.33 mm	速度：	500 MHz
最小供电电压：	2 V	标称供电电压：	2 V
表面贴装：	NO	技术：	CMOS
端子形式：	PIN/PEG	端子节距：	2.54 mm
端子位置：	PERPENDICULAR	宽度：	49.53 mm
uPs/uCs/外围集成电路类型：	MICROPROCESSOR	Base Number Matches：	1

80524RX500128 数据手册

Intel^®Celeron™ Processor

Table 44. Input Signals (Sheet 2 of 2)

Name

Active Level

Clock

Signal Group

TAP Input

Qualified

TDI

High

TCK

TESTHI

(S.E.P.P.

only)

High

Asynch

Power/Other

Always

THERMDP

TMS

N/A

High

Low

Asynch

TCK

Power/Other

TAP Input

TRST#

TRDY#

Asynch

BCLK

TAP Input

AGTL+ Input

NOTE:

1. Synchronous assertion with active TRDY# ensures synchronization.

Table 45. Input/Output Signals (Single Driver)

Name

Active Level

Clock

Signal Group

Power/Other

Qualified

BSEL

BP[3:2]

Low

Asynch

BCLK

Always

AGTL+ I/O

A[31:3]#

ADS#

ADS#, ADS#+1

Always

BPM[1:0]#

D[63:0]#

DBSY#

Always

DRDY#

Always

DRDY#

LOCK#

Always

REQ[4:0]#

ADS#, ADS#+1

Table 46. Input/Output Signals (Multiple Driver)

Name

Active Level

Clock

Signal Group

Qualified

BNR#

HIT#

Low

High

BCLK

AGTL+ I/O

APIC I/O

Always

HITM#

PICD[1:0]

BCLK

PICCLK

Datasheet

1...83 84 8586

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