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7C372I-125

更新时间： 2022-05-11 09:19:49

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赛普拉斯 - CYPRESS		/
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描述
UltraLogic 64-Macrocell Flash CPLD

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7C372I-125 数据手册

CY7C372i

Selection Guide

7C372i-125 7C372i-100 7C372i-83 7C372iL-83 7C372i-66 7C372iL-66

Maximum Propagation Delay^[1], t_PD(ns)

Minimum Set-up, t_S(ns)

Maximum Clock to Output^[1], t_CO(ns)

5.5

6.5

6.0

6.5

Typical Supply Current, I_CC(mA)

Pin Configurations

PLCC

TopView

CLCC

TopView

44 43 42 41 40

I/O /SCLK

I/O /SDI

I/O /SCLK

I/O

ISR

CLK /I

ISR

GND

CLK /I

I/O

18 19 20 21 22 23 24 25 26 27 28

Note:

1. The 3.3V I/O mode timing adder, t

, must be added to this specification when V

= 3.3V.

3.3IO

CCIO

Document #: 38-03033 Rev. *A

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