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74HC05

更新时间： 2024-01-13 14:31:13
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德州仪器 - TI 输出元件
页数 文件大小 规格书
4页 68K
描述
HEX INVERTERS WITH OPEN-DRAIN OUTPUTS

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74HC05 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Transferred零件包装代码：TSSOP
包装说明：4.40 MM, PLASTIC, MO-153, SOT402-1, TSSOP-14针数：14
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.79系列：HC/UH
JESD-30 代码：R-PDSO-G14JESD-609代码：e4
长度：5 mm逻辑集成电路类型：INVERTER
湿度敏感等级：1功能数量：6
输入次数：1端子数量：14
最高工作温度：125 °C最低工作温度：-40 °C
输出特性：OPEN-DRAIN封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
传播延迟（tpd）：135 ns认证状态：Not Qualified
座面最大高度：1.1 mm最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：NICKEL PALLADIUM GOLD
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：4.4 mm

74HC05 数据手册

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SN54HC05, SN74HC05  
HEX INVERTERS  
WITH OPEN-DRAIN OUTPUTS  
SCLS080B – MARCH 1984 – REVISED MAY 1997  
SN54HC05 . . . J OR W PACKAGE  
SN74HC05 . . . D OR N PACKAGE  
(TOP VIEW)  
Package Options Include Plastic  
Small-Outline (D) and Ceramic Flat (W)  
Packages, Ceramic Chip Carriers (FK), and  
Standard Plastic (N) and Ceramic (J)  
300-mil DIPs  
1A  
1Y  
V
CC  
1
2
3
4
5
6
7
14  
13  
12  
11  
6A  
6Y  
5A  
2A  
description  
2Y  
These devices contain six independent inverters.  
They perform the Boolean function Y = A in  
positive logic. The open-drain outputs require  
pullup resistors to perform correctly. They may be  
connected to other open-drain outputs to  
implement active-low wired-OR or active-high  
wired-AND functions.  
3A  
10 5Y  
9
8
3Y  
4A  
4Y  
GND  
SN54HC05 . . . FK PACKAGE  
(TOP VIEW)  
The SN54HC05 is characterized for operation  
over the full military temperature range of –55°C  
to 125°C. The SN74HC05 is characterized for  
operation from –40°C to 85°C.  
3
2
1
20 19  
18  
6Y  
NC  
5A  
2A  
NC  
2Y  
4
5
6
7
8
17  
16  
FUNCTION TABLE  
(each inverter)  
15 NC  
14  
9 10 11 12 13  
NC  
3A  
5Y  
INPUT  
A
OUTPUT  
Y
H
L
L
H
NC – No internal connection  
†
logic symbol  
2
1
1
1Y  
1A  
2A  
3A  
4A  
5A  
6A  
3
4
2Y  
6
5
3Y  
8
9
4Y  
11  
13  
10  
5Y  
12  
6Y  
†
This symbol is in accordance with ANSI/IEEE Std 91-1984 and IEC Publication 617-12.  
Pin numbers shown are for the D, J, N, and W packages.  
logic diagram (positive logic)  
A
Y
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 1997, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234

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