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5CEBA2F17C6

更新时间： 2024-01-21 19:11:52

品牌	Logo	应用领域
英特尔 - INTEL		栅可编程逻辑
页数	文件大小	规格书
64页	1355K
描述
Field Programmable Gate Array, PBGA256, FBGA-256

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5CEBA2F17C6 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	LBGA, BGA256,16X16,40	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	2
JESD-30 代码：	S-PBGA-B256	长度：	17 mm
输入次数：	128	逻辑单元数量：	25000
输出次数：	128	端子数量：	256
最高工作温度：	85 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	LBGA
封装等效代码：	BGA256,16X16,40	封装形状：	SQUARE
封装形式：	GRID ARRAY, LOW PROFILE	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	1.1,1.2/3.3,2.5 V	可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY
认证状态：	Not Qualified	座面最大高度：	1.55 mm
子类别：	Field Programmable Gate Arrays	最大供电电压：	1.13 V
最小供电电压：	1.07 V	标称供电电压：	1.1 V
表面贴装：	YES	技术：	CMOS
温度等级：	OTHER	端子形式：	BALL
端子节距：	1 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	17 mm
Base Number Matches：	1

5CEBA2F17C6 数据手册

Page 58

Glossary

Table 63 lists the glossary for this datasheet.

Table 63. Glossary Table (Part 1 of 4)

Letter

Subject

Definitions

—

Receiver Input Waveforms

Single-Ended Waveform

Positive Channel (p) = V

Negative Channel (n) = V

Ground

Differential Waveform

p − n = 0 V

Differential I/O

Standards

Transmitter Output Waveforms

Single-Ended Waveform

Positive Channel (p) = V

Negative Channel (n) = V

Ground

Differential Waveform

p − n = 0 V

—

f_HSCLK

Left/right PLL input clock frequency.

High-speed I/O block—Maximum/minimum LVDS data transfer rate

(f_HSDR= 1/TUI).

f_HSDR

—

Cyclone V Device Datasheet

December 2013 Altera Corporation

1...55 56 575859 60 61...64

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5CEBA2F17I7	INTEL	获取价格	Field Programmable Gate Array, PBGA256, FBGA-256
5CEBA2F17I7N	ALTERA	获取价格	Field Programmable Gate Array, PBGA256, ROHS COMPLIANT, FBGA-256
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