Datasheet > 电源电路 > 开关式稳压器或控制器> 5962-9455501MXA

5962-9455501MXA

更新时间： 2024-02-18 04:29:07

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德州仪器 - TI		控制器
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19页	740K
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Phase Shift Resonant Controller

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5962-9455501MXA 技术参数

生命周期：	Active	零件包装代码：	DIP
包装说明：	DIP-20	针数：	20
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	Factory Lead Time：	26 weeks
风险等级：	5.22	Is Samacsys：	N
其他特性：	CAN ALSO BE CONFIGURED IN CURRENT MODE	模拟集成电路 - 其他类型：	SWITCHING CONTROLLER
控制模式：	VOLTAGE-MODE	控制技术：	RESONANT CONTROL
最大输入电压：	20 V	最小输入电压：	11 V
标称输入电压：	12 V	JESD-30 代码：	R-GDIP-T20
长度：	24.195 mm	功能数量：	1
端子数量：	20	最高工作温度：	125 °C
最低工作温度：	-55 °C	最大输出电流：	3 A
最大输出电压：	5.08 V	最小输出电压：	4.92 V
标称输出电压：	5 V	封装主体材料：	CERAMIC, GLASS-SEALED
封装代码：	DIP	封装等效代码：	DIP20,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
峰值回流温度（摄氏度）：	NOT SPECIFIED	认证状态：	Qualified
筛选级别：	MIL-PRF-38535 Class V	座面最大高度：	5.08 mm
子类别：	Switching Regulator or Controllers	表面贴装：	NO
切换器配置：	PHASE-SHIFT	最大切换频率：	2000 kHz
技术：	BIPOLAR	温度等级：	MILITARY
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7.62 mm	Base Number Matches：	1

5962-9455501MXA 数据手册

UC1875/6/7/8

UC2875/6/7/8

UC3875/6/7/8

ELECTRICAL CHARACTERISTICS:Unless otherwise stated, –55°C < T_A< 125°C for the UC1875/6/7/8, –25°C < T_A

85°C for the UC2875/6/7/8 and 0°C < T_A< 70°C for the UC3875/6/7/8, VC = VIN = 12V, R_FREQSET= 12kΩ, C_FREQSET= 330pF,

_SLOPE= 12kΩ, C_RAMP= 200pF, C_{DELAYSET A-B}= C_{DELAYSET C-D}= 0.01µF, I_{DELAYSET A-B}= I_{DELAYSET C-D}= –500µA, T_A= T_J.

PARAMETER

TEST CONDITIONS

MIN

TYP

MAX UNITS

Soft-Start/Reset Delay

Charge Current

_SOFTSTART= 0.5V

_SOFTSTART= 1V

–20

120

4.3

–9

230

4.7

300

–3

µA

Discharge Current

Restart Threshold

Discharge Level

Output Drivers

Output Low Level

I_OUT= 50mA

0.2

1.2

1.5

1.7

0.4

2.6

2.5

2.6

_OUT= 500mA

_OUT= –50mA

Output High Level

I_OUT= –500mA

Delay Set (UC1875 and UC1876 only)

Delay Set Voltage

I_DELAY= –500µA

2.3

2.4

2.6

Delay Time, (Note 8)

_DELAY= –250µA (Note 5) (UC3875/6/7/8,

150

250

400

nsec

UC2875/6/7/8)

I_DELAY= –250µA (Note 5) (UC1875/6/7/8)

150

250

600

nsec

200

Note 1: Phase shift percentage (0% = 0°, 100% = 180°) is defined as θ =

fined in Figure 1. At 0% phase shift, F is the output skew.

Φ%, where q is the phase shift, and F and T are de-

Note 2: Delay time is defined as delay = T (1/2–(duty cycle)), where T is defined in Fig. 1.

Note 3: Ramp offset voltage has a temperature coefficient of about –4mV/°C.

Note 4: Zero phase shift voltage has a temperature coefficient of about –2mV/°C.

62 .5 •10^–12

Note 5: Delay time can be programmed via resistors from the delay set pins to ground. Delay time ≅

sec. Where

I_DELAY

Delay set voltage

The recommended range for I

is 25mA £ I

£ 1mA

DELAY

R_DELAY

Note 6: Ramp delay to output time is defined in Fig. 2.

Note 7: Not production tested at -55 C.

Duty Cycle = t/T

(A to C) = T

Period = T

(B to D) = Φ

DHL

UDG-95074

UDG-95075

Phase Shift, Output Skew & Delay Time Definitions

Figure 1

Figure 2

1 2 3 456 7 8...19

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