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24LC128

更新时间： 2024-02-25 14:53:36

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美国微芯 - MICROCHIP		可编程只读存储器电动程控只读存储器电可擦编程只读存储器
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128K I 2 C ⑩ CMOS Serial EEPROM

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24LC128 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	ROHS COMPLIANT, PLASTIC, TSSOP-8	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.51	风险等级：	5.22
其他特性：	1000000 ERASE/WRITE CYCLES, HARDWARE WRITE PROTECT, DATA RETENTION > 200 YEARS	最大时钟频率 (fCLK)：	0.4 MHz
数据保留时间-最小值：	200	耐久性：	1000000 Write/Erase Cycles
I2C控制字节：	1010DDDR	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e3	长度：	4.4 mm
内存密度：	131072 bit	内存集成电路类型：	EEPROM
内存宽度：	8	湿度敏感等级：	1
功能数量：	1	端子数量：	8
字数：	16384 words	字数代码：	16000
工作模式：	SYNCHRONOUS	最高工作温度：	85 °C
最低工作温度：	-40 °C	组织：	16KX8
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP8,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	并行/串行：	SERIAL
峰值回流温度（摄氏度）：	260	电源：	3/5 V
认证状态：	Not Qualified	座面最大高度：	1.2 mm
串行总线类型：	I2C	最大待机电流：	0.000001 A
子类别：	EEPROMs	最大压摆率：	0.003 mA
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	2.5 V
标称供电电压 (Vsup)：	4.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	Matte Tin (Sn)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	40	宽度：	3 mm
最长写入周期时间 (tWC)：	5 ms	写保护：	HARDWARE
Base Number Matches：	1

24LC128 数据手册

24AA128/24LC128

FIGURE 5-1: CONTROL BYTE FORMAT

5.0

DEVICE ADDRESSING

A control byte is the ﬁrst byte received following the

start condition from the master device (Figure 5-1).The

control byte consists of a 4-bit control code; for the

24xx128 this is set as 1010 binary for read and write

operations. The next three bits of the control byte are

the chip select bits (A2, A1, A0). The chip select bits

allow the use of up to eight 24xx128 devices on the

same bus and are used to select which device is

accessed. The chip select bits in the control byte must

correspond to the logic levels on the corresponding A2,

A1, and A0 pins for the device to respond. These bits

are in effect the three most signiﬁcant bits of the word

address.

Read/Write Bit

Chip Select

Control Code

Bits

A2 A1 A0 R/W ACK

Slave Address

Acknowledge Bit

Start Bit

5.1

Contiguous Addressing Across

Multiple Devices

The last bit of the control byte deﬁnes the operation to

be performed. When set to a one a read operation is

selected, and when set to a zero a write operation is

selected. The next two bytes received deﬁne the

address of the ﬁrst data byte (Figure 5-2). Because

only A13…A0 are used, the upper two address bits are

don’t care bits. The upper address bits are transferred

ﬁrst, followed by the less signiﬁcant bits.

The chip select bits A2, A1, A0 can be used to expand

the contiguous address space for up to 1 Mbit by add-

ing up to eight 24xx128's on the same bus. In this case,

software can use A0 of the control byte as address bit

A14; A1, as address bit A15; and A2, as address bit

A16. It is not possible to sequentially read across

device boundaries.

Following the start condition, the 24xx128 monitors the

SDA bus checking the device type identiﬁer being

transmitted. Upon receiving a 1010 code and appropri-

ate device select bits, the slave device outputs an

acknowledge signal on the SDA line. Depending on the

state of the R/W bit, the 24xx128 will select a read or

write operation.

FIGURE 5-2: ADDRESS SEQUENCE BIT ASSIGNMENTS

CONTROL BYTE

ADDRESS HIGH BYTE

ADDRESS LOW BYTE

•

R/W

12 11

CONTROL

CODE

CHIP

SELECT

BITS

X = Don’t Care Bit

DS21191B-page 6

1998 Microchip Technology Inc.

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