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100311QCX_NL

更新时间： 2024-01-02 09:49:19
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 驱动逻辑集成电路
页数 文件大小 规格书
6页 64K
描述
Low Skew Clock Driver, 100K Series, 9 True Output(s), 0 Inverted Output(s), ECL, PQCC28, 0.450 X 0.450 INCH, LEAD FREE, MO-047, PLASTIC, LCC-28

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100311QCX_NL 技术参数

生命周期：Obsolete零件包装代码：LCC
包装说明：QCCJ,针数：28
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.25系列：100K
输入调节：DIFFERENTIALJESD-30 代码：S-PQCC-J28
JESD-609代码：e3长度：11.43 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER功能数量：1
反相输出次数：端子数量：28
实输出次数：9最高工作温度：85 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装形状：SQUARE
封装形式：CHIP CARRIER传播延迟（tpd）：1.24 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.05 ns
座面最大高度：4.57 mm最大供电电压 (Vsup)：3.8 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：ECL
温度等级：OTHER端子面层：MATTE TIN
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD宽度：11.43 mm
最小 fmax：750 MHzBase Number Matches：1

100311QCX_NL 数据手册

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Industrial Version (Continued)  
DC Electrical Characteristics (Note 9)  
V
EE = −4.2V to −5.7V, VCC = VCCA = GND  
T
C = −40°C  
TC = 0°C to +85°C  
Symbol  
Parameter  
Units  
Conditions  
Min  
Max  
Min  
Max  
VIL  
Input LOW Voltage  
−1830  
−1480  
−1830  
−1475  
mV  
Guaranteed LOW Signal for  
All Inputs  
IIL  
Input LOW Current  
Input HIGH Current  
CLKIN, CLKIN  
0.50  
0.50  
µA  
µA  
V
V
IN = VIL (Min)  
IN = VIH (Max)  
IIH  
100  
250  
100  
250  
EN  
ICBO  
IEE  
Input Leakage Current  
Power Supply Current  
Minimum Input Swing  
Common Mode Range  
−10  
−115  
150  
−10  
−115  
150  
µA  
mA  
mV  
V
V
IN = VEE  
−57  
−57  
Inputs Open  
VPP  
VCMR  
V
CC−2.0  
V
CC−0.5  
V
CC−2.0  
VCC−0.5  
Note 9: The specified limits represent the “worst case” value for the parameter. Since these values normally occur at the temperature extremes, additional  
noise immunity and guardbanding can be achieved by decreasing the allowable system operating ranges. Conditions for testing shown in the tables are cho-  
sen to guarantee operation under “worst case” conditions.  
AC Electrical Characteristics  
VEE = −4.2V to −5.7V, VCC = VCCA = GND  
T
C = −40°C  
T
C = +25°C  
T
C = +85°C  
Symbol  
fMAX  
Parameter  
Units  
Conditions  
Min  
Typ  
Max  
Min  
Typ  
Max  
Min  
Typ  
Max  
Max Toggle Frequency  
CLKIN to Qn  
750  
750  
750  
MHz (Note 10)  
tPLH  
tPHL  
Propagation Delay,  
CLKINn to CLKn  
Differential  
0.72  
0.62  
0.70  
0.81  
0.89  
0.97  
0.92  
1.02  
1.20  
0.77  
0.67  
0.80  
0.86  
0.93  
1.05  
0.95  
1.17  
1.25  
0.84  
0.74  
0.85  
0.93  
1.06  
1.12  
1.04  
1.24  
1.35  
ns  
ns  
Figure 3  
Figure 2  
Single-Ended  
tPLH  
tPHL  
tPS  
Propagation Delay  
SEL to Output  
LH–HL Skew  
10  
20  
20  
30  
30  
50  
50  
60  
10  
20  
20  
30  
30  
50  
50  
60  
10  
20  
20  
30  
30  
50  
50  
60  
(Note 11)(Note 14)  
(Note 12)(Note 14)  
(Note 12)(Note 14)  
(Note 13)(Note 14)  
tOSLH  
tOSHL  
tOST  
tS  
Gate–Gate Skew LH  
Gate–Gate Skew HL  
Gate–Gate LH–HL Skew  
Setup Time  
ps  
250  
0
250  
0
300  
0
ps  
ps  
ps  
ps  
ENn to CLKINn  
tH  
Hold Time  
ENn to CLKINn  
tR  
Release Time  
300  
275  
300  
275  
300  
275  
ENn to CLKINn  
tTLH  
tTHL  
Transition Time  
20% to 80%, 80% to 20%  
500  
750  
480  
750  
460  
750  
Figure 4  
Note 10: fMAX = the highest frequency of which output VOL/VOH levels still meet VIN specifications. The F311 will function @ 1 GHz  
Note 11: tPS describes opposite edge skews, i.e. the difference between the delay of a differential output signal pair's LOW-to-HIGH and HIGH-to-LOW prop-  
agation delays. With differential signal pairs, a LOW-to-HIGH or HIGH-to-LOW transition is defined as the transition of the true output or input pin.  
Note 12: tOSLH describes in-phase gate differential propagation skews with all differential outputs going LOW-to-HIGH; tOSHL describes the same conditions  
except with the outputs going HIGH-to-LOW.  
Note 13: tOST describes the maximum worst case difference in any of the tPS, tOSLH or tOST delay paths combined.  
Note 14: The skew specifications pertain to differential I/O paths.  
www.fairchildsemi.com  
4
123456

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