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ZL38012LDG1

更新时间： 2024-11-23 18:59:55
品牌 Logo 应用领域
加拿大卓联 - ZARLINK PC电信电信集成电路
页数 文件大小 规格书
7页 90K
描述
PCM Codec, 1-Func, 8 X 8 MM, 0.90 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, MO-220, QFN-56

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ZL38012LDG1 技术参数

生命周期：Transferred包装说明：HVQCCN,
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.73滤波器：YES
JESD-30 代码：S-XQCC-N56JESD-609代码：e3
长度：8 mm功能数量：1
端子数量：56工作模式：ASYNCHRONOUS
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
座面最大高度：1 mm标称供电电压：1.2 V
表面贴装：YES电信集成电路类型：PCM CODEC
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD宽度：8 mm
Base Number Matches：1

ZL38012LDG1 数据手册

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ZL38012  
Voice Processor with  
Dual Narrow Band Codecs  
Data Sheet  
September 2010  
A full Design Manual is available to qualified  
customers. To register, please send an email to  
VoiceProcessing@Zarlink.com.  
Ordering Information  
ZL38012LDG1  
56 Pin QFN*  
*Pb Free Matte Tin  
Features  
-40C to +85C  
•
100 MHz (200 MIPs) Zarlink voice processor with  
hardware accelerator.  
•
•
•
Bootloadable for future Zarlink software upgrades  
External oscillator or crystal/ceramic resonator  
1.2 V Core; 3.3 V IO with 5 V-tolerant inputs  
•
Dual 8 kHz sampling  ADCs with input buffer  
gain selection  
•
•
Dual 8 kHz DACs with internal output driver  
Dual function Inter-IC Sound (I2S) port or TDM  
Port  
Applications  
•
•
•
•
•
Hands-free car kits  
•
•
PCM port supports TDM (ST BUS, GCI or McBSP  
framing) or SSI modes at bit rates of 128, 256, 512,  
1024, 2048, 4096, 8192 or 16384 Kb/sec  
Full duplex speaker-phone for digital telephone  
Echo cancellation for video conferences  
Intercom Systems  
Separate slave (microcontroller) and master  
(Flash) SPI ports, maximum clock rate = 25 MHz  
•
•
5 General Purpose Input/Output (GPIO) pins  
General purpose UART port  
Security Systems  
OSCo  
100 MHz MCLK  
CODEC[0]  
APLL  
OSC  
Interrupt  
ADC  
OSCi  
Instruction  
Memory  
Controller  
DAC  
3K  
Bytes  
ROM  
RAM  
Driver  
DSP  
27K  
Bytes  
Core  
Timing  
Generator  
CODEC[1:0]  
CODEC[1]  
Device Clocks  
ADC  
DAC  
Hardware  
Accelerator  
Data RAM  
5
/
Master  
SPI  
24K  
Bytes  
Filter  
Co-processor  
Driver  
4
/
5
/
Slave  
SPI  
PCM  
I2S  
2
/
UART  
GPIO  
5
/
Figure 1 - Functional Block Diagram  
1
Zarlink Semiconductor Inc.  
Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.  
Copyright 2010, Zarlink Semiconductor Inc. All Rights Reserved.  
1234567

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