ZL30107GGG

更新时间： 2024-02-06 14:46:07

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GbE Line Card Synchronizer

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ZL30107GGG 技术参数

生命周期：	Transferred	包装说明：	BGA,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.67	Is Samacsys：	N
JESD-30 代码：	S-PBGA-B64	长度：	9 mm
功能数量：	1	端子数量：	64
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	BGA
封装形状：	SQUARE	封装形式：	GRID ARRAY
认证状态：	Not Qualified	座面最大高度：	1.72 mm
标称供电电压：	1.8 V	表面贴装：	YES
电信集成电路类型：	TELECOM CIRCUIT	温度等级：	INDUSTRIAL
端子形式：	BALL	端子节距：	1 mm
端子位置：	BOTTOM	宽度：	9 mm
Base Number Matches：	1

ZL30107GGG 数据手册

ZL30107

GbE Line Card Synchronizer

Shortform Data Sheet

March 2007

A full Data Sheet is available to qualified customers. To

Ordering Information

please

send

ZL30107GGG

64 Pin CABGA

Trays

TimingandSync@zarlink.com.

ZL30107GGG2 64 Pin CABGA*

*Pb Free Tin/Silver/Copper

Features

-40^oC to +85^oC

•

Single chip low cost solution for synchronizing an

Ethernet PHY to a standard telecom clock

•

Configurable to accept a 25 MHz input reference

Generates an IEEE 802.3 jitter compliant 25 MHz

Gigabit Ethernet output clock

Supports three modes of operation:

Asynchronous Freerun, Synchronous, and

Asynchronous Holdover

Automatic entry into Asynchronous Holdover

mode when all input references fail

Input reference is manually selectable through the

serial (SPI) interface

•

Defaults in Asynchronous Freerun mode

•

Hitless input reference switching

Lock indicator pin

In Asynchronous Freerun mode, the DPLL

generates an output clock with a frequency

accuracy equal to frequency accuracy of the

external crystal oscillator (XO) or a low cost

crystal (XTAL)

Input reference status monitors

Programmable loop bandwidth of 14 Hz, 28 Hz, or

890 Hz

•

In Synchronous mode, the DPLL automatically

synchronizes to one of a pre-defined set of

frequencies including 2 kHz, 8 kHz, 64 kHz,

1.544 MHz, 2.048 MHz, 6.48 MHz, 8.192 MHz,

16.384 MHz, 19.44 MHz, 38.88 MHz, 77.76 MHz.

Applications

•

Ethernet Line Cards Supporting Synchronous

Transmission

X1/CLK X2

LOCK

REF0

REF1

REF2

DPLL

CLK

APLL

uP I/F

Figure 1 - Block Diagram

Zarlink Semiconductor Inc.

Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.

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型号	品牌	获取价格	描述	数据表
ZL30107GGG2	ZARLINK	获取价格	GbE Line Card Synchronizer
ZL30108	ZARLINK	获取价格	Network Interface DPLL
ZL30108	MICROCHIP	获取价格	The?ZL30108?SONET/SDH network interface digital phase-locked loop (DPLL) provides timing a
ZL30108_06	ZARLINK	获取价格	SONET/SDH Network Interface DPLL
ZL30108LDA	ZARLINK	获取价格	Network Interface DPLL
ZL30108LDA	XILINX	获取价格	ATM/SONET/SDH SUPPORT CIRCUIT, QCC32, 5 X 5 MM, MO-220, QFN-32
ZL30108LDE1	ZARLINK	获取价格	SONET/SDH Network Interface DPLL
ZL30108LDG1	XILINX	获取价格	ATM/SONET/SDH SUPPORT CIRCUIT, QCC32, 5 X 5 MM, 0.90 MM HEIGHT, 0.50 MM PITCH, LEAD FREE,
ZL30108LDG1	MICROCHIP	获取价格	ATM/SONET/SDH Support Circuit, 1-Func
ZL30108LDG1	ZARLINK	获取价格	Support Circuit, 1-Func, CMOS, 5 X 5 MM, 0.90 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, MO-220,

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