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X25128P-2.7

更新时间： 2024-11-11 22:11:19

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XICOR		存储内存集成电路光电二极管可编程只读存储器电动程控只读存储器电可擦编程只读存储器时钟
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SPI Serial E 2 PROM with Block Lock TM Protection

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X25128P-2.7 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	PLASTIC, DIP-8	Reach Compliance Code：	unknown
风险等级：	5.89	Is Samacsys：	N
其他特性：	BLOCK LOCK PROTECTION; DATA RETENTION 100 YEARS; 1 MILLION ENDURANCE CYCLES	最大时钟频率 (fCLK)：	2 MHz
数据保留时间-最小值：	100	耐久性：	100000 Write/Erase Cycles
JESD-30 代码：	R-PDIP-T8	JESD-609代码：	e0
长度：	10.03 mm	内存密度：	131072 bit
内存集成电路类型：	EEPROM	内存宽度：	8
功能数量：	1	端子数量：	8
字数：	16384 words	字数代码：	16000
工作模式：	SYNCHRONOUS	最高工作温度：	70 °C
最低工作温度：		组织：	16KX8
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP8,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
并行/串行：	SERIAL	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	3/5 V	认证状态：	Not Qualified
座面最大高度：	4.32 mm	串行总线类型：	SPI
最大待机电流：	0.000001 A	子类别：	EEPROMs
最大压摆率：	0.005 mA	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	2.7 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7.62 mm	最长写入周期时间 (tWC)：	10 ms
写保护：	HARDWARE/SOFTWARE	Base Number Matches：	1

X25128P-2.7 数据手册

A^PPLICATIONN^OTE

A V A I L A B L

AN61

128K

16K x 8 Bit

X25128

SPI Serial E²PROM with Block Lock^TMProtection

FEATURES

DESCRIPTION

• 2MHz Clock Rate

The X25128 is a CMOS 131,072-bit serial E PROM,

internally organized as 16K x 8. The X25128 features

a Serial Peripheral Interface (SPI) and software

protocol allowing operation on a simple three-wire bus.

The bus signals are a clock input (SCK) plus separate

data in (SI) and data out (SO) lines. Access to the

device is controlled through a chip select (CS) input,

allowing any number of devices to share the same

bus.

• SPI Modes (0,0 & 1,1)

• 16K X 8 Bits

—32 Byte Page Mode

• Low Power CMOS

—<1µA Standby Current

—<5mA Active Current

• 2.7V To 5.5V Power Supply

• Block Lock Protection

—Protect 1/4, 1/2 or all of E PROM Array

• Built-in Inadvertent Write Protection

—Power-Up/Power-Down protection circuitry

—Write Enable Latch

The X25128 also features two additional inputs that

provide the end user with added ﬂexibility. By

asserting the HOLD input, the X25128 will ignore tran-

sitions on its inputs, thus allowing the host to service

higher priority interrupts. The WP input can be used as

a hardwire input to the X25128 disabling all write

attempts to the status register, thus providing a mech-

anism for limiting end user capability of altering 0, 1/4,

1/2 or all of the memory.

—Write Protect Pin

• Self-Timed Write Cycle

—5ms Write Cycle Time (Typical)

• High Reliability

—Endurance: 100,000 cycles

—Data Retention: 100Years

—ESD protection: 2000V on all pins

• 14-Lead SOIC Package

The X25128 utilizes Xicor’s proprietary Direct Write™

cell, providing a minimum endurance of 100,000

cycles and a minimum data retention of 100 years.

• 16-Lead SOIC Package

• 8-Lead PDIP Package

FUNCTIONAL DIAGRAM

WRITE

STATUS

PROTECT

X DECODE

LOGIC

16K BYTE

ARRAY

LOGIC

128

16 X 256

32 X 256

COMMAND

DECODE

128

256

AND

CONTROL

LOGIC

SCK

HOLD

WRITE

CONTROL

AND

TIMING

LOGIC

Y DECODE

DATA REGISTER

3091 FM F01

Xicor Inc. 1994, 1995, 1996 Patents Pending

3091-2.9 5/14/97 T2/C0/D2 SH

Characteristics subject to change without notice

12 3 4 5 6 7...15

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