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W154HT

更新时间： 2024-01-13 15:14:26
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟光电二极管外围集成电路晶体
页数 文件大小 规格书
8页 108K
描述
Clock Generator, 100MHz, CMOS, PDSO48, 0.300 INCH, MO-118AA, SSOP-48

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W154HT 技术参数

生命周期：Obsolete零件包装代码：SSOP
包装说明：0.300 INCH, MO-118AA, SSOP-48针数：48
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.76
JESD-30 代码：R-PDSO-G48JESD-609代码：e0
长度：15.88 mm端子数量：48
最高工作温度：70 °C最低工作温度：
最大输出时钟频率：100 MHz封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH主时钟/晶体标称频率：14.31818 MHz
认证状态：Not Qualified座面最大高度：2.79 mm
最大供电电压：3.465 V最小供电电压：3.135 V
标称供电电压：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.635 mm端子位置：DUAL
宽度：7.52 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER
Base Number Matches：1

W154HT 数据手册

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W154  
Laser Printer System Frequency Synthesizer  
Table 2. Spread Characteristics  
Features  
CPU(0:3),  
• Employs Cypress’s proprietary Spread Spectrum  
technology for EMI suppression  
SS%1 SS%0 ESSON# CSSON# SDRAM(0:11) ECLK  
• Reduces measured EMI by as much as 10 dB  
• Four skew-controlled copies of CPU output  
• Twelve skew-controlled copies of SDRAM output  
• One copy of 14.31818-MHz Reference output  
• Separate SS enable pins for Ethernet output and  
CPU/SDRAM outputs  
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
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1
0
1
0
1
0
1
0
1
0
1
–0.5%  
0 (off)  
–0.5%  
0 (off)  
–1.0%  
0 (off)  
–1.0%  
0 (off)  
–2.5%  
0 (off)  
–2.5%  
0 (off)  
–3.75%  
0 (off)  
–3.75%  
0 (off)  
–0.5%  
–0.5%  
0 (off)  
0 (off)  
–1.0%  
–1.0%  
0 (off)  
0 (off)  
–2.5%  
–2.5%  
0 (off)  
0 (off)  
–3.75%  
–3.75%  
0 (off)  
0 (off)  
• Selectable SSFTG modulation width  
• Available in 48-pin SSOP  
Key Specifications  
Supply Voltage: ........................................ VDD = 3.3V ± 10%  
CPU Clock Cycle to Cycle Jitter: ................................250 ps  
CPU0:3, SDRAM0:11 Clock Skew: ............................250 ps  
CPU, SDRAM Output on Resistance:.............................15Ω  
Logic inputs have 250 kΩ pull-up resistors  
Table 1. Pin-selectable Frequency  
FS1  
FS0  
CPU(0:3), SDRAM(0:11)  
ECLK  
0
0
1
1
0
1
0
1
reserved  
100 MHz  
66.6 MHz  
50 MHz  
reserved  
50 MHz  
50 MHz  
50 MHz  
Block Diagram  
Pin Configuration  
GND  
VDD  
1
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
ESSON#  
REF  
X1  
X2  
GND  
XTAL  
OSC  
2
VDD  
3
ECLK  
VDD  
REF  
4
PLL Ref Freq  
GND  
5
VDD  
X1  
X2  
GND  
6
GND  
GND  
7
CSSON#  
8
CPU0  
CPU1  
VDD  
CPU2  
CPU3  
GND  
SDRAM0  
SDRAM1  
VDD  
SDRAM11  
SDRAM10  
VDD  
SDRAM9  
SDRAM8  
GND  
SDRAM7  
SDRAM6  
VDD  
9
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
SS%1  
SS%0  
CPU0:3  
MUX  
SDRAM0:3  
PLL 1  
SDRAM2  
SDRAM3  
GND  
SDRAM4:7  
SDRAM8:11  
SDRAM5  
SDRAM4  
GND  
FS0  
FS1  
VDD  
VDD  
SS%1  
CSSON#  
FS1  
SD4EN  
SD8EN  
SS%0  
SD4EN  
SD8EN  
FS0  
ESSON#  
MUX  
ECLK  
PLL 2  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Document #: 38-07314 Rev. **  
Revised April 2, 2002  
12345678

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型号 品牌 描述 获取价格 数据表
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