VSC7135

更新时间： 2024-01-02 15:19:08

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描述
1.25Gbits/sec Gigabit Ethernet Transceiver

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VSC7135 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	10 X 10 MM, THERMALLY ENHANCED, PLASTIC, QFP-64
针数：	64	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.88
Is Samacsys：	N	数据速率：	1250000 Mbps
JESD-30 代码：	S-PQFP-G64	JESD-609代码：	e0
长度：	10 mm	功能数量：	1
端子数量：	64	收发器数量：	1
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	FQFP	封装等效代码：	QFP64,.51SQ,20
封装形状：	SQUARE	封装形式：	FLATPACK, FINE PITCH
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	3.3 V
认证状态：	Not Qualified	座面最大高度：	2.45 mm
子类别：	Network Interfaces	最大压摆率：	0.29 mA
标称供电电压：	3.3 V	表面贴装：	YES
技术：	GAAS	电信集成电路类型：	ETHERNET TRANSCEIVER
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	10 mm
Base Number Matches：	1

VSC7135 数据手册

VITESSE

SEMICONDUCTOR CORPORATION

Data Sheet

1.25Gbits/sec

Gigabit Ethernet Transceiver

VSC7135

Features

• Gigabit Ethernet Transceiver @ 1.25Gb/s

• Low Power Operation - 700 mW

• Compliant to IEEE 802.3Z PMA

• Suitable for Both Coaxial or Optical Link

Applications

• TTL Interface Compatible to PMA-TBI

• Monolithic Clock Synthesis and Clock

Recovery - No External Components

• 64 Pin, 14mm or 10mm Standard PQFP

• Single +3.3V Supply

• 125MHz TTL Reference Clock

General Description

The VSC7135 is a 1.25Gb/s Ethernet Transceiver optimized for Gigabit Ethernet or 1000Base-X applica-

tions. It accepts 10-bit 8B/10B encoded transmit data, latches it on the rising edge of REFCLK and serializes it

onto the TX PECL differential outputs at a baud rate which is ten times the REFCLK frequency. The VSC7135

also samples serial receive data on the RX PECL differential inputs, recovers the clock and data, deserializes it

onto the 10-bit receive data bus, outputs two recovered clocks at one-twentieth of the incoming baud rate and

detects “Comma” characters. The VSC7135 contains on-chip PLL circuitry for synthesis of the baud-rate trans-

mit clock, and extraction of the clock from the received serial stream. These circuits are fully monolithic and

require no external components.

VSC7135 Block Diagram

EWRAP

Q D

Serial to

Parallel

R0:9

RX+

RX-

Q D

Retimed

Data

Clock

Recovery

2:1

÷ 10

÷ 20

Recovered

Clock

RCLK

RCLKN

Comma

Detect

Frame

Logic

Resync

COM_DET

EN_CDET

TX+

TX-

Parallel

to Serial

D Q

T0:9

Serial Data

Synthesized

Clock

PLL Clock

Multiply

REFCLK

G52146-0, Rev. 4.0

5/28/98

VITESSE SEMICONDUCTOR CORPORATION

741 Calle Plano, Camarillo, CA 93012 • 805/388-3700 • FAX: 805/987-5896

Page 1

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