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V103YLF

更新时间： 2024-02-03 04:01:30

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矽成 - ICSI		驱动器接口集成电路
页数	文件大小	规格书
11页	150K
描述
TRIPLE 10-BIT LVDS TRANSMITTER FOR VIDEO

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V103YLF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	TFQFP, TQFP64,.47SQ	针数：	64
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.82
Is Samacsys：	N	差分输出：	YES
驱动器位数：	6	输入特性：	STANDARD
接口集成电路类型：	LINE DRIVER	接口标准：	GENERAL PURPOSE
JESD-30 代码：	S-PQFP-G64	JESD-609代码：	e3
长度：	10 mm	功能数量：	6
端子数量：	64	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	TFQFP	封装等效代码：	TQFP64,.47SQ
封装形状：	SQUARE	封装形式：	FLATPACK, THIN PROFILE, FINE PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3 V
认证状态：	Not Qualified	最大接收延迟：
座面最大高度：	1.2 mm	子类别：	Line Driver or Receivers
最大压摆率：	93 mA	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	10 mm	Base Number Matches：	1

V103YLF 数据手册

V103

TRIPLE 10-BIT LVDS TRANSMITTER FOR VIDEO

General Description

Features

The V103 LVDS display interface transmitter is

primarily designed to support pixel data transmission

between a video processing engine and a digital video

display. The data rate supports up to SXGA+

resolutions and can be used in Plasma, Rear Projector,

Front Projector, CRT and LCD display applications. It

can also be used in other high-bandwidth parallel data

applications and provides a low EMI interconnect over

a low cost, low bus width cable up to several meters in

length.

• Pin compatible with THine THC63LVD103

• Wide pixel clock range: 8 - 135 MHz

• Supports a wide range of video and graphics modes

including VGA, SVGA, XGA, SXGA, SXGA+, NTSC,

PAL, SDTV, and HDTV up to 1080I or 720P

• Internal PLL requires no external loop filter

• Selectable rising or falling clock edge for data

alignment

• Compatible with Spread Spectrum clock source

The V103 converts 35 bits of CMOS/TTL data, clocked

on the rising or falling edge of an input clock

(selectable), into six LVDS (Low Voltage Differential

Signaling) serial data stream pairs. In video

applications the 35 bits is normally divided into 10 bits

for each R, G and B channel and 5 control bits.

• Reduced LVDS output voltage swing mode

(selectable) to minimize EMI

• CMOS/TTL data inputs can be configured for

reduced input voltage swing

• Single 3.3 V supply

When combined with the V104 LVDS display interface

receiver, the V103 + V104 combination provides a

35-bit wide, 90 MHz transport. The rate of each LVDS

channel is 630 Mbps for a 90MHz data input clock, 945

Mbps for 135MHz.

• Low power consumption CMOS design

• Power down mode

• 64-pin TQFP lead free package

Block Diagram

TA+

TA-

TA0-6

TB0-6

TB+

TB-

TC0-6

TD0-6

Parallel

to Serial

TC+

TC-

TE0-6

TD+

TD-

R/F

/PWDN

TE+

TE-

TCLK+

TCLK-

CLKIN

(8 to 135 MHz)

PLL

V103 Datasheet

11/23/06

Revision 2.0

Integrated Circuit Systems • 525 Race Street, San Jose, CA 95126 • tel (408) 297-1201 • www.icst.com

12 3 4 5 6 7...11

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型号	品牌	获取价格	描述	数据表
V103YLFT	ICSI	获取价格	TRIPLE 10-BIT LVDS TRANSMITTER FOR VIDEO
V104	ICSI	获取价格	10 BIT LVDS RECEIVER FOR VIDEO
V-104-1A4	OMRON	获取价格	Miniature Basic Switch that Offers High Reliability and Security
V-104-1A4-T	OMRON	获取价格	Snap Action Switch
V-104-1A4-T-K	OMRON	获取价格	Snap Acting/Limit Switch, SPDT, Momentary, 10A, 8VDC, 5.6mm, Solder Terminal, Simulated Ro
V-104-1A5	OMRON	获取价格	Miniature Basic Switch that Offers High Reliability and Security
V-104-1A5-T	OMRON	获取价格	Miniature Basic Switch that Offers High Reliability and Security
V-104-1C24	OMRON	获取价格	Miniature Basic Switch that Offers High Reliability and Security
V-104-1C24-T	OMRON	获取价格	Miniature Basic Switch that Offers High Reliability and Security
V-104-1C25	OMRON	获取价格	Miniature Basic Switch that Offers High Reliability and Security

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