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Datasheet > 电源电路 > 开关式稳压器或控制器> UCC18502J
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UCC18502J

更新时间： 2024-11-28 13:15:07
品牌 Logo 应用领域
德州仪器 - TI 功率因数校正控制器
页数 文件大小 规格书
8页 93K
描述
1A POWER FACTOR CONTROLLER, CDIP20, CERAMIC, DIP-20

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UCC18502J 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：DIP包装说明：CERAMIC, DIP-20
针数：20Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.92Is Samacsys：N
模拟集成电路 - 其他类型：POWER FACTOR CONTROLLER控制模式：CURRENT-MODE
控制技术：PULSE FREQUENCY MODULATION最大输入电压：16 V
最小输入电压：10.8 V标称输入电压：12 V
JESD-30 代码：R-CDIP-T20功能数量：1
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C最大输出电流：1 A
封装主体材料：CERAMIC, METAL-SEALED COFIRED封装代码：DIP
封装等效代码：DIP20,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
认证状态：Not Qualified子类别：Switching Regulator or Controllers
表面贴装：NO切换器配置：PUSH-PULL
最大切换频率：250 kHz技术：BICMOS
温度等级：MILITARY端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIEDBase Number Matches：1

UCC18502J 数据手册

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UCC18500/1/2/3  
UCC28500/1/2/3  
UCC38500/1/2/3  
PRELIMINARY  
BiCMOS PFC/PWM Combination Controller  
FEATURES  
• Combines PFC and 2nd Stage Down  
DESCRIPTION  
The UCC18500 family provides all of the functions necessary for an ac-  
tive power factor corrected preregulator and a second stage DC-to-DC  
converter. The controller achieves near-unity power factor by shaping  
the AC input line current waveform to correspond to the AC input line  
voltage using average current mode control. The DC-to-DC converter  
uses peak current mode control to perform the step down power con-  
version.  
Converter Function  
• Controls Boost PWM to Near-unity Power  
Factor  
• Accurate Power Limiting  
• Average Current Mode Control in PFC  
Stage  
The PFC stage is leading edge modulated while the second stage is  
trailing edge synchronized to allow for minimum overlap between the  
boost and PWM switches. This reduces ripple current in the bulk output  
capacitor.  
• Peak Current Mode Control in Second  
Stage  
• Programmable Oscillator  
In order to operate with a three to one range of input line voltages, a  
line feedforward (VFF) in used to keep input power constant with vary-  
ing input voltage. Generation of VFF is done using IAC in conjunction  
with an external single pole filter. This not only reduces external parts  
count, but avoids the use of high voltage components offering a lower  
cost solution. The multiplier then divides the line current by the square  
• Leading Edge/Trailing Edge Modulation  
for Reduced Output Ripple Using  
SmartSync™  
• Low Startup Supply Current  
• Synchronized Second Stage Start-up,  
with Programmable Soft-start  
of VFF  
.
(continued)  
• Programmable Second Stage Shut-down  
BLOCK DIAGRAM  
ISENSE2  
8
SS2  
13  
VCC  
9
GND  
6
VERR  
7
7.5V  
REFERENCE  
SECOND STAGE  
SOFT START  
20 VREF  
6.75V  
UVLO2  
1.5V  
UVLO  
16V/10  
VCC  
OVP/ENBL  
4
ENABLE  
–
+
I
LIMIT  
10  
GT2  
R
R
S
1.5V  
1.3V  
8.0V  
+
–
PFCOVP  
Q
ZERO  
VAOUT  
1
3
PWM  
CLK2  
POWER  
VOLTAGE  
ERROR AMP  
0.25V  
–
+
VSENSE  
–
+
X
VCC  
MULT  
CURRENT AMP  
÷
–
+
–
X
Q
S
PWM  
PWM  
+
7.5V  
12 GT1  
2
VFF 19  
OSC  
LATCH  
(V  
)
FF  
R
R
CLK1  
CLK2  
MIRROR  
2:1  
11 PWRGND  
CLK1  
CLK2  
I
LIMIT  
OSCILLATOR  
IAC 18  
14 PKLMT  
–
+
MOUT 17  
16  
15  
2
5
ISENSE1 CAOUT  
RT  
CT  
UDG-98189  
SLUS419 - AUGUST 1999  
12345678

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型号 品牌 获取价格 描述 数据表
UCC18502N TI

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 		1A POWER FACTOR CONTROLLER, PDIP20, PLASTIC, DIP-20
UCC18503 TI

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 		BiCMOS PFC/PWM Combination Controller
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