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UC3714J PDF预览

UC3714J

更新时间： 2023-12-18 00:00:00
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德州仪器 - TI 驱动接口集成电路驱动器
页数 文件大小 规格书
8页 297K
描述
2A BUF OR INV BASED MOSFET DRIVER, CDIP8

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UC3714J 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP,针数：8
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.79
高边驱动器：YES接口集成电路类型：BUFFER OR INVERTER BASED MOSFET DRIVER
JESD-30 代码：R-GDIP-T8功能数量：1
端子数量：8最高工作温度：70 °C
最低工作温度：标称输出峰值电流：2 A
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装形状：RECTANGULAR封装形式：IN-LINE
认证状态：Not Qualified座面最大高度：5.08 mm
最大供电电压：20 V最小供电电压：7 V
标称供电电压：15 V表面贴装：NO
温度等级：COMMERCIAL端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
断开时间：0.1 µs接通时间：0.1 µs
宽度：7.62 mmBase Number Matches：1

UC3714J 数据手册

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application  
INFO  
UC1714/5  
UC2714/5  
UC3714/5  
available  
Complementary Switch FET Drivers  
FEATURES  
DESCRIPTION  
• Single Input (PWM and TTL  
These two families of high speed drivers are designed to provide drive  
waveforms for complementary switches. Complementary switch configura-  
tions are commonly used in synchronous rectification circuits and active  
clamp/reset circuits, which can provide zero voltage switching. In order to  
facilitate the soft switching transitions, independently programmable delays  
between the two output waveforms are provided on these drivers. The de-  
lay pins also have true zero voltage sensing capability which allows imme-  
diate activation of the corresponding switch when zero voltage is applied.  
These devices require a PWM-type input to operate and can be interfaced  
with commonly available PWM controllers.  
Compatible)  
• High Current Power FET Driver, 1.0A  
Source/2A Sink  
• Auxiliary Output FET Driver, 0.5A  
Source/1A Sink  
• Time Delays Between Power and  
Auxiliary Outputs Independently  
Programmable from 50ns to 500ns  
In the UC1714 series, the AUX output is inverted to allow driving a  
p-channel MOSFET. In the UC1715 series, the two outputs are configured  
in a true complementary fashion.  
• Time Delay or True Zero-Voltage  
Operation Independently Configurable  
for Each Output  
• Switching Frequency to 1MHz  
• Typical 50ns Propagation Delays  
• ENBL Pin Activates 220µA Sleep  
Mode  
• Power Output is Active Low in Sleep  
Mode  
• Synchronous Rectifier Driver  
BLOCK DIAGRAM  
2
PWR  
50ns –500ns  
TIMER  
INPUT  
T1  
6
7
S
Q
R
UC1714  
ONLY  
V
REF  
4
1
AUX  
VCC  
50ns –500ns  
TIMER  
S
Q
V
5V  
BIAS  
ENBL  
LOGIC  
GATES  
CC  
T2  
5
R
V
REF  
TIMER  
REF  
3V  
GND  
3
GND  
1.4V  
ENBL  
8
ENABLE  
Note: Pin numbers refer to J, N and D packages.  
UDG-99028  
SLUS170A - FEBRUARY 1999 - REVISED JANUARY 2002  
12345678

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型号 品牌 获取价格 描述 数据表
UC3714N TI

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