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UC2843DWTR

更新时间： 2024-02-19 11:58:27
品牌 Logo 应用领域
德州仪器 - TI 控制器
页数 文件大小 规格书
8页 436K
描述
1A SWITCHING CONTROLLER, 500kHz SWITCHING FREQ-MAX, PDSO16

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UC2843DWTR 技术参数

生命周期：Obsolete包装说明：SOP,
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.65
模拟集成电路 - 其他类型：SWITCHING CONTROLLER控制模式：CURRENT-MODE
控制技术：PULSE WIDTH MODULATION最大输入电压：25 V
最小输入电压：8.2 VJESD-30 代码：R-PDSO-G16
长度：10.365 mm功能数量：1
端子数量：16最高工作温度：85 °C
最低工作温度：-25 °C最大输出电流：1 A
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
认证状态：Not Qualified座面最大高度：2.64 mm
表面贴装：YES切换器配置：SINGLE
最大切换频率：500 kHz技术：BIPOLAR
温度等级：OTHER端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：7.5 mmBase Number Matches：1

UC2843DWTR 数据手册

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UC1842/3/4/5  
UC2842/3/4/5  
UC3842/3/4/5  
Current Mode PWM Controller  
FEATURES  
DESCRIPTION  
•
Optimized For Off-line And DC  
To DC Converters  
The UC1842/3/4/5 family of control ICs provides the necessary features to im-  
plement off-line or DC to DC fixed frequency current mode control schemes  
with a minimal external parts count. Internally implemented circuits include un-  
der-voltage lockout featuring start up current less than 1mA, a precision refer-  
ence trimmed for accuracy at the error amp input, logic to insure latched  
operation, a PWM comparator which also provides current limit control, and a  
totem pole output stage designed to source or sink high peak current. The out-  
put stage, suitable for driving N Channel MOSFETs, is low in the off state.  
•
•
Low Start Up Current (<1mA)  
Automatic Feed Forward  
Compensation  
•
•
Pulse-by-pulse Current Limiting  
Enhanced Load Response  
Characteristics  
Differences between members of this family are the under-voltage lockout  
thresholds and maximum duty cycle ranges. The UC1842 and UC1844 have  
UVLO thresholds of 16V (on) and 10V (off), ideally suited to off-line applica-  
tions. The corresponding thresholds for the UC1843 and UC1845 are 8.4V  
and 7.6V. The UC1842 and UC1843 can operate to duty cycles approaching  
100%. A range of zero to 50% is obtained by the UC1844 and UC1845 by the  
addition of an internal toggle flip flop which blanks the output off every other  
clock cycle.  
•
Under-voltage Lockout With  
Hysteresis  
•
•
Double Pulse Suppression  
High Current Totem Pole  
Output  
•
Internally Trimmed Bandgap  
Reference  
•
•
500khz Operation  
Low RO Error Amp  
BLOCK DIAGRAM  
Note 1: A/B A = DIL-8 Pin Number. B = SO-14 Pin Number.  
Note 2: Toggle flip flop used only in 1844 and 1845.  
4/97  
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