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Datasheet > 信号电路 > 锁相环或频率合成电路> TRF3761-BIRHAR
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TRF3761-BIRHAR

更新时间： 2024-11-28 03:26:31
品牌 Logo 应用领域
德州仪器 - TI /
页数 文件大小 规格书
56页 1456K
描述
INTEGER-N PLL WITH INTEGRATED VCO

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TRF3761-BIRHAR 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：QFN包装说明：HVQCCN, LCC40,.24SQ,20
针数：40Reach Compliance Code：compliant
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：5.81其他特性：DUAL MODULUS PRESCALER : 8/9, 16/17, 32/33, 64/65
模拟集成电路 - 其他类型：PLL FREQUENCY SYNTHESIZERJESD-30 代码：S-PQCC-N40
JESD-609代码：e4长度：6 mm
湿度敏感等级：3功能数量：1
端子数量：40最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：HVQCCN封装等效代码：LCC40,.24SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：5 V
认证状态：Not Qualified座面最大高度：1 mm
子类别：PLL or Frequency Synthesis Circuits最大供电电压 (Vsup)：5.25 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：6 mm

TRF3761-BIRHAR 数据手册

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TRF3761  
www.ti.com  
SLWS181F–OCTOBER 2005–REVISED JANUARY 2007  
INTEGER-N PLL WITH INTEGRATED VCO  
FEATURES  
(See Note A)  
R2  
•
Fully Integrated VCO  
C1  
C3  
R1  
C2  
•
Low Phase Noise: –137dBc/Hz (at 600kHz, fVCO  
of 1.9GHz )  
C4  
1000 pF  
•
•
•
Low Noise Floor: –158dBc/Hz at 10MHz Offset  
Integer-N PLL  
Input Reference Frequency range: 10MHz to  
104MHz  
40 39 38 37 36 35 34 33 32 31  
PD_OUTBUF  
CHIP_EN  
CLOCK  
1
30  
29  
28  
27  
26  
25  
24  
23  
22  
21  
GND  
R3  
2.37 kΩ  
2
AVDD_BIAS  
RBIAS1  
3
•
•
•
•
•
•
VCO Frequency Divided by 2-4 Output  
Output Buffer Enable Pin  
4
DATA  
GND  
5
STROBE  
DGND  
VCTRL_IN  
AVDD_VCO  
AVDD_BUF  
TRF3761  
(TOP VIEW)  
6
Programmable Charge Pump Current  
Hardware and Software Power Down  
3-Wire Serial Interface  
7
DGND  
8
DVDD1  
AVDD_CAPARRAY  
GND  
9
AVDD_PRES  
GND  
10  
AVDD  
11 12 13 14 15 16 17 18 19 20  
Single Supply: 4.5V to 5.25V Operation  
APPLICATIONS  
•
Wireless Infrastructure  
R4  
4.75 kΩ  
C7  
1000 pF  
R5  
120 Ω  
R6  
120 Ω  
–
–
–
–
–
–
WCDMA, CDMA, GSM  
Wideband Transceivers  
Wireless Local Loop  
RFID Transceivers  
Clock generation  
V
DD  
V
DD  
C5  
10 pF  
C6  
10 pF  
LOAD  
A. See the Application Information section for  
Loop Filter Design procedures.  
IF LO generation  
AVAILABLE DEVICE OPTIONS  
Div by 1  
Div by 2  
Div by 4  
PART NUMBER  
Fstart  
1493  
1595  
1660  
1740  
1805  
1850  
1920  
2028  
2140  
2225  
Fstop  
1608  
1711  
1790  
1866  
1936  
1984  
2059  
2175  
2295  
2386  
Fstart  
746.5  
797.5  
830  
Fstop  
804  
Fstart  
373.25  
398.75  
415  
Fstop  
402  
TRF3761-A  
TRF3761-B  
TRF3761-C  
TRF3761-D  
TRF3761-E  
TRF3761-F  
TRF3761-G  
TRF3761-H  
TRF3761-J  
TRF3761-K  
855.5  
895  
427.75  
447.5  
466.5  
484  
870  
933  
435  
902.5  
925  
968  
451.25  
462.5  
480  
992  
496  
960  
1029.5  
1087.5  
1147.5  
1193  
514.75  
543.75  
573.75  
596.5  
1014  
1070  
1112.5  
507  
535  
556.25  
DESCRIPTION  
TRF3761 is a family of high performance, highly integrated frequency synthesizers, optimized for high  
performance applications. The TRF3761 includes a low-noise, voltage-controlled oscillator (VCO) and an  
integer-N PLL.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 2005–2007, Texas Instruments Incorporated  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
1234567...56

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