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TPA5051RSAR

更新时间： 2024-11-18 03:58:47
品牌 Logo 应用领域
德州仪器 - TI 消费电路商用集成电路
页数 文件大小 规格书
19页 512K
描述
FOUR CHANNEL DIGITAL AUDIO LIP-SYNC DELAY WITH I2C CONTROL

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TPA5051RSAR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFN
包装说明：HVQCCN, LCC16,.16SQ,25针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.33.00.01Factory Lead Time：1 week
风险等级：0.65商用集成电路类型：CONSUMER CIRCUIT
JESD-30 代码：S-PQCC-N16JESD-609代码：e4
长度：4 mm湿度敏感等级：2
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：HVQCCN
封装等效代码：LCC16,.16SQ,25封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
电源：3 V认证状态：Not Qualified
座面最大高度：1 mm子类别：Other Consumer ICs
最大压摆率：3 mA最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：NO LEAD端子节距：0.65 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4 mmBase Number Matches：1

TPA5051RSAR 数据手册

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A5051  
TP  
TPA5051  
www.ti.com  
SLOS497A–JUNE 2006–REVISED JULY 2006  
FOUR CHANNEL DIGITAL AUDIO LIP-SYNC DELAY WITH I2C CONTROL  
FEATURES  
•
APPLICATIONS  
Digital Audio Format: 16-24-bit I2S,  
Right-Justified, Left-Justified  
•
•
•
•
High Definition Lip-Sync Delay  
Flat Panel TV Lip-Sync Delay  
Home Theater Rear Channel Effects  
Wireless Speaker Front-Channel  
Synchronization  
•
•
•
•
•
I2C Bus Controlled  
Dual Serial Input Ports  
Delay Time: 85 ms/ch at fs = 48 kHz  
Delay Resolution: One Sample  
DESCRIPTION  
Delay Memory Cleared on Power-Up or After  
Delay Changes  
The TPA5051 accepts two serial audio inputs,  
buffers the data for a selectable period of time, and  
outputs the delayed audio data on two serial outputs.  
One device allows delay of up to 85 ms/ch (fs = 48  
kHz) to synchronize the audio stream to the video  
stream in systems with complex video processing  
algorithms. If more delay is needed, the devices can  
be connected in series. Independent clocks can be  
used for each audio input.  
– Eliminates Erroneous Data on Output  
•
•
•
3.3 V Operation With 5 V Tolerant I/O and I2C  
Control  
Supports Audio Bit Clock Rates of 32 to 64 fs  
with fs = 32 kHz–192 kHz  
No External Crystal or Oscillator Required  
– All Internal Clocks Generated From the  
Audio Clock  
•
•
Independent Clocks for Each Audio Input  
Surface Mount 4mm × 4mm, 16-pin QFN  
Package  
SIMPLIFIED APPLICATION DIAGRAM  
Audio Processor  
SCLK  
Digital Amplfiier  
TAS5504A  
+ TAS5122  
TAS3108  
or  
ATSC  
3.3 V  
Processor  
TPA5051  
SCLK  
BCLK1  
BCLK1  
LRCLK1  
DATA1  
BCLK1  
LRCLK1  
DATA1  
DATA2  
BCLK2  
LRCLK1  
DATA_OUT1  
DATA_OUT2  
DATA1  
DATA2  
BCLK2  
DATA2  
BCLK2  
LRCLK2  
LRCLK2  
LRCLK2  
3
2
I C Delay  
Control  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 2006, Texas Instruments Incorporated  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
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