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TLV320AIC3253IYZKR

更新时间： 2024-11-08 07:04:35
品牌 Logo 应用领域
德州仪器 - TI 解码器编解码器消费电路商用集成电路
页数 文件大小 规格书
33页 646K
描述
Ultra Low Power Stereo Audio Codec With Embedded miniDSP

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TLV320AIC3253IYZKR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：BGA
包装说明：VFBGA, BGA25,5X5,20针数：25
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：6 weeks
风险等级：0.71商用集成电路类型：CONSUMER CIRCUIT
JESD-30 代码：S-XBGA-B25JESD-609代码：e1
长度：2.795 mm湿度敏感等级：1
功能数量：1端子数量：25
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：UNSPECIFIED封装代码：VFBGA
封装等效代码：BGA25,5X5,20封装形状：SQUARE
封装形式：GRID ARRAY, VERY THIN PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：1.8 V认证状态：Not Qualified
座面最大高度：0.625 mm子类别：Other Consumer ICs
最大供电电压 (Vsup)：1.95 V最小供电电压 (Vsup)：1.5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Silver/Copper (Sn/Ag/Cu)
端子形式：BALL端子节距：0.5 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：2.795 mmBase Number Matches：1

TLV320AIC3253IYZKR 数据手册

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TLV320AIC3253  
www.ti.com  
SLOS631 –MARCH 2010  
Ultra Low Power Stereo Audio Codec With Embedded miniDSP  
Check for Samples: TLV320AIC3253  
1
FEATURES  
APPLICATIONS  
•
•
•
Mobile Handsets  
Communication  
Portable Computing  
2
•
•
•
•
•
•
•
•
•
•
•
Stereo Audio DAC with 100dB SNR  
4.1mW Stereo 48ksps Playback  
PowerTune™  
Extensive Signal Processing Options  
Embedded miniDSP  
DESCRIPTION  
The TLV320AIC3253 (sometimes referred to as the  
AIC3253) is a flexible, low-power, low-voltage stereo  
audio codec with digital microphone inputs and  
programmable outputs, PowerTune capabilities,  
fully-programmable miniDSP, fixed predefined and  
parameterizable signal processing blocks, integrated  
PLL, integrated LDO and flexible digital interfaces.  
Stereo Digital Microphone Input  
Stereo Headphone Outputs  
Low Power Analog Bypass Mode  
Programmable PLL  
Integrated LDO  
Extensive  
register-based  
control  
of  
power,  
2.7mm × 2.7mm WCSP or 4mm × 4mm QFN  
Package  
input/output channel configuration, gains, effects,  
pin-multiplexing and clocks is included, allowing the  
device to be precisely targeted to its application.  
INL  
Vol. Ctrl  
DRC  
INR  
-6...+29dB  
DAC Signal Proc.  
*
Left  
DAC  
+
HPL  
HPR  
DMDIN/  
MFP3  
Dig.  
ADC Signal Proc.  
1dB steps  
-6...+29dB  
miniDSP  
Mic IF  
DMCLK/  
MFP4  
miniDSP  
Right  
DAC  
+
DAC Signal Proc.  
DRC  
*
1dB steps  
ALDO  
Vol. Ctrl  
LDOin  
AVdd  
SPI / I2C  
Control Block  
SPI_Select  
Reset  
Interrupt Secondary  
Ctrl  
I2S IF  
Primary  
PLL  
I2S Interface  
IOVdd  
DVdd  
IOVss  
DVss  
AVss  
Mic Bias  
Ref  
Pin Muxing/ Clock Routing  
Figure 1. Simplified Block Diagram  
1
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
2
PowerTune is a trademark of Texas Instruments.  
UNLESS OTHERWISE NOTED this document contains  
PRODUCTION DATA information current as of publication date.  
Products conform to specifications per the terms of Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
Copyright © 2010, Texas Instruments Incorporated  
 
1234567...33

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