Datasheet > 逻辑 > 触发器/锁存器> 5962-9314801QSA

5962-9314801QSA

更新时间： 2024-01-08 04:36:46

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德州仪器 - TI		触发器锁存器逻辑集成电路信息通信管理时钟
页数	文件大小	规格书
14页	462K
描述
OCTAL EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLOCK ENABLE

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5962-9314801QSA 技术参数

生命周期：	Obsolete	零件包装代码：	DFP
包装说明：	DFP,	针数：	20
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.32	Is Samacsys：	N
其他特性：	WITH HOLD MODE	系列：	ABT
JESD-30 代码：	R-GDFP-F20	逻辑集成电路类型：	D FLIP-FLOP
位数：	8	功能数量：	1
端子数量：	20	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出极性：	TRUE
封装主体材料：	CERAMIC, GLASS-SEALED	封装代码：	DFP
封装形状：	RECTANGULAR	封装形式：	FLATPACK
传播延迟（tpd）：	7.6 ns	认证状态：	Qualified
筛选级别：	MIL-PRF-38535 Class Q	座面最大高度：	2.286 mm
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	BICMOS	温度等级：	MILITARY
端子形式：	FLAT	端子节距：	1.27 mm
端子位置：	DUAL	触发器类型：	POSITIVE EDGE
宽度：	6.731 mm	最小 fmax：	150 MHz
Base Number Matches：	1

5962-9314801QSA 数据手册

SN54ABT377, SN74ABT377

OCTAL EDGE-TRIGGERED D-TYPE FLIP-FLOPS

WITH CLOCK ENABLE

SCBS156B – FEBRUARY 1991 – REVISED JULY 1994

SN54ABT377 . . . J PACKAGE

SN74ABT377 . . . DB, DW, OR N PACKAGE

(TOP VIEW)

• State-of-the-Art EPIC-ΙΙB BiCMOS Design

Significantly Reduces Power Dissipation

• Latch-Up Performance Exceeds 500 mA

Per JEDEC Standard JESD-17

CLKEN

• Typical V

(Output Ground Bounce)

OLP

< 1 V at V

= 5 V, T = 25°C

• High-Drive Outputs (–32-mA I

64-mA I

)

• Package Options Include Plastic

Small-Outline (DW) and Shrink

13 5D

12 5Q

Small-Outline (DB) Packages, Ceramic

Chip Carriers (FK), and Plastic (N) and

Ceramic (J) DIPs

GND

CLK

description

SN54ABT377 . . . FK PACKAGE

(TOP VIEW)

The ′ABT377 are 8-bit positive-edge-triggered

D-type flip-flops with a clock (CLK) input. They are

particularly suitable for implementing buffer and

storage registers, shift registers, and pattern

generators.

20 19

18 8D

Data (D) input information that meets the setup

time requirements is transferred to the Q outputs

on the positive-going edge of the clock pulse if the

commonclock-enable(CLKEN)inputislow. Clock

triggering occurs at a particular voltage level and

is not directly related to the transition time of the

positive-going pulse. When the buffered clock

(CLK) input is at either the high or low level, the

D input signal has no effect at the output. The

circuits are designed to prevent false clocking by

transitions at CLKEN.

9 10 11 12 13

The SN74ABT377 is available in TI’s shrink small-outline package (DB), which provides the same I/O pin count

and functionality of standard small-outline packages in less than half the printed-circuit-board area.

The SN54ABT377 is characterized for operation over the full military temperature range of –55°C to 125°C. The

SN74ABT377 is characterized for operation from –40°C to 85°C.

FUNCTION TABLE

(each flip-flop)

INPUTS

OUTPUT

CLKEN CLK

↑

H or L

EPIC-ΙΙB is a trademark of Texas Instruments Incorporated.

PRODUCTION DATA information is current as of publication date.

Products conform to specifications per the terms of Texas Instruments

standard warranty. Production processing does not necessarily include

testing of all parameters.

2–1

POST OFFICE BOX 655303 • DALLAS, TEXAS 75265

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